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特性
- 冗余输入参考时钟功能
- 参考监控功能
- 全集成式VCO/PLL内核
- 抖动(rms)
0.234 ps rms抖动(10 kHz至10 MHz,156.25 MHz时)
0.243 ps rms抖动(12 kHz至20 MHz,156.25 MHz时) - 输入频率: 19.44 MHz或25 MHz
- 预设频率转换
- 采用19.44 MHz输入参考
19.44 MHz、38.88 MHz、77.76 MHz、155.52 MHz - 采用25 MHz输入参考
25 MHz、33.33 MHz、50 MHz、66.67 MHz、80 MHz、100 MHz、125 MHz、133.3 MHz、156.25 MHz、160 MHz、312.5 MHz - 欲了解更多特性,请参考数据手册
AD9574具有多路输出时钟发生器功能,内置专用锁相环(PLL)内核,针对以太网和千兆以太网线路卡应用进行了优化。 整数N PLL设计基于ADI公司成熟的高性能、低抖动频率合成器产品系列,确保实现高的网络性能。 AD9574还适合要求低相位噪声和抖动性能的其他应用。
配置AD9574以用于特定应用时,只需将外部上拉或下拉电阻连接到适当的引脚编程读取器引脚(PPRx)即可。 通过这些引脚可以控制内部分频器,以建立所需的频率转换、时钟输出功能和输入参考功能。 将外部19.44 MHz或25 MHz振荡器连接到参考输入REF0_P/REF0_N和REF1_P/REF1_N或其中之一时,便可得到PPRx引脚规定的一组输出频率。 将稳定的时钟源(8 kHz/10 MHz/19.44 MHz/25 MHz/38.88 MHz)连接到监控器时钟输入时,可选监控器电路便可提供REF0或REF1的服务质量(QoS)状态。
PLL部分由低噪声鉴频鉴相器(PFD)、精密电荷泵(CP)、部分集成环路滤波器(LF)、低相位噪声电压控制振荡器(VCO)、反馈分频器和输出分频器组成。 分频器值取决于PPRx引脚。 集成环路滤波器只要求将单个外部电容连接到LF引脚。
AD9574采用48引脚7 mm × 7 mm LFCSP封装,只需3.3 V单电源, 工作温度范围为−40°C至+85°C。
应用
- 以太网线路卡、交换机和路由器
- SATA 和 PCI Express
- 低抖动、低相位噪声时钟产生
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AD9574
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参考资料
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产品型号 | 引脚/封装图-中文版 | 文档 | CAD 符号,脚注和 3D模型 |
---|---|---|---|
AD9574BCPZ | 48-Lead LFCSP (7mm x 7mm w/ EP) |
|
|
AD9574BCPZ-REEL7 | 48-Lead LFCSP (7mm x 7mm w/ EP) |
|
- AD9574BCPZ
- 引脚/封装图-中文版
- 48-Lead LFCSP (7mm x 7mm w/ EP)
- 文档
- HTML Material Declaration
- HTML Reliablity Data
- CAD 符号,脚注和 3D模型
- Ultra Librarian
- SamacSys
- AD9574BCPZ-REEL7
- 引脚/封装图-中文版
- 48-Lead LFCSP (7mm x 7mm w/ EP)
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根据型号筛选
产品型号
产品生命周期
PCN
11月 26, 2014
- 14_0238
AD9574 Datasheet specification change
AD9574BCPZ
量产
AD9574BCPZ-REEL7
量产
根据型号筛选
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11月 26, 2014
- 14_0238
AD9574 Datasheet specification change
软件和型号相关生态系统
评估套件 1
EVAL-AD9574
AD9574 评估板
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