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PLL部分由低噪声鉴频鉴相器(PFD)、精密电荷泵、低相位噪声压控振荡器(VCO)、预编程的反馈分频器和输出分频器组成。
通过连接一个外部25 MHz晶振，可以将100 MHz和33.33 MHz输出频率锁定至输入参考。输出分频比和反馈分频比可针对所要求的输出速率进行预编程。无需外部环路滤波器，从而节省宝贵的设计时间和电路板空间。
AD9573提供16引脚、4.4 mm × 5.0 mm TSSOP封装，可以采用3.3 V单电源供电。温度范围为−40°C至+85°C。
应用
- 线路卡、交换机和路由器
- CPU/PCIe 应用
- 低抖动、低相位噪声时钟产生
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AD9573
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参考资料
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| 产品型号 | 引脚/封装图-中文版 | 文档 | CAD 符号，脚注和 3D模型 |
|---|---|---|---|
| AD9573ARUZ |
16-Lead TSSOP
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| AD9573ARUZ-RL7 |
16-Lead TSSOP
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- AD9573ARUZ
- 引脚/封装图-中文版
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16-Lead TSSOP
- 文档
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Material Declaration
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Reliablity Data
- CAD 符号，脚注和 3D模型
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Ultra Librarian
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SamacSys
- AD9573ARUZ-RL7
- 引脚/封装图-中文版
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16-Lead TSSOP
- 文档
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