AD9277
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AD9277

八通道LNA/VGA/AAF/14位ADC与CW I/Q解调器

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特性
  • 八通道LNA、VGA、AAF、ADC与I/Q解调器
  • 低噪声前置放大器(LNA) - 欲了解更多信息,请参考数据手册。
  • 可变增益放大器(VGA)
    衰减器范围:−42 dB至0 dB
    后置放大器增益:21 dB/24 dB/27 dB/30 dB
    线性dB增益控制
  • 抗混叠滤波器(AAF)
    可编程二阶LPF范围:8 MHz至18 MHz
    可编程HPF
  • 模数转换器(ADC) - 欲了解更多信息,请参考数据手册。
  • CW模式I/Q解调器
    独立可编程相位旋转
    每个通道的输出动态范围:>160 dBFS/√Hz
  • 低功耗:在14位/50 MSPS (TGC)时,每个通道为207 mW;在CW多普勒模式下,每个通道为94 mW
  • 灵活的省电模式
  • 过载恢复时间:<10 ns
  • 可从低功耗待机模式快速恢复:<2 μs
  • 100引脚TQFP_EP封装
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AD9277针对低成本、低功耗、小尺寸及易于使用的应用而设计。它内置八通道的可变增益放大器(VGA)、低噪声前置放大器(LNA)、抗混叠滤波器(AAF)、14位10 MSPS至50 MSPS模数转换器(ADC)以及具有可编程相位旋转的I/Q解调器。

每个通道均具有42 dB的可变增益范围、完全差分信号路径、有源输入前置放大器终端、最大52 dB的增益以及转换速率高达50 MSPS的ADC。通道专门针对动态范围与低功耗而优化,适合要求小封装尺寸的应用。

LNA具有单端转差分增益,可以通过SPI进行选择。增益为21.3 dB时,LNA输入噪声典型值为0.75 nV/√Hz;在最大增益下,所有通道的折合到输入端噪声为0.85 nV/√Hz。假设噪声带宽为15 MHz且LNA增益为21.3 dB,则输入信噪比(SNR)约为92 dB。在CW多普勒模式下,各LNA输出驱动一个I/Q解调器。各解调器具有16种相位设置,可以通过SPI实现独立可编程相位旋转。

AD9277要求采用LVPECL/CMOS/LVDS兼容型采样速率时钟信号,以便充分发挥其工作性能。对于大多数应用来说,无需外部基准电压源或驱动器件。

为获得合适的LVDS串行数据速率,该ADC会自动倍乘采样速率时钟。它提供一个数据时钟(DCO±)用于在输出端捕获数据,以及一个帧时钟(FCO±)触发器用于发送新输出字节信号。

各通道可单独进入省电模式,从而延长便携式应用的电池使用时间。利用待机模式选项可以快速上电,以便开机重启。以CW多普勒模式工作时,VGA、AAF和ADC均进入省电模式。TGC路径的功耗与可选ADC速度功耗模式成正比。

该ADC内置多种功能特性,例如可编程时钟、数据对准、生成可编程数字测试码等,可使器件的灵活性达到较佳、系统成本降至较低。数字测试码包括内置的固定码和伪随机码,以及通过串行端口接口输入的用户自定义测试码。

AD9277采用先进的CMOS工艺制造,提供16 mm × 16 mm、符合RoHS标准的100引脚TQFP封装,额定温度范围为−40°C至+85°C工业温度范围。

应用

  • 医疗成像/超声
  • 汽车雷达

提示:AD927x系列简介
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产品技术资料帮助

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参考资料

产品型号 引脚/封装图-中文版 文档 CAD 符号,脚注和 3D模型
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HSC-ADC-EVALCZ

基于FPGA的数据采集套件

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HSC-ADC-EVALCZ

基于FPGA的数据采集套件

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特性和优点

  • 64kB FIFO深度
  • 适用于单通道和多通道ADC
  • 与VisualAnalog®软件配合使用
  • 基于Virtex-4 FPGA
  • 可能需要适配器,才能与某些ADC评估板接口
  • 允许对SPI控制进行编程 每个通道的DDR编码速率高达644 MSPS SDR / 800MSPS
  • 每个通道的DDR编码速率

产品详情

HSC-ADC-EVALCZ高速转换器评估平台使用基于FPGA的缓冲存储器板,采集来自ADI高速模数转换器(ADC)评估板的数字数据块。该板通过USB端口连接到PC,并与VisualAnalog®软件配合使用来快速评估高速ADC的性能。该评估套件设置简单。所需的额外设备包括ADI高速ADC评估板、信号源和时钟源。一旦连接该套件并上电,PC便立即开始评估。

EVAL-AD9277

AD9277 评估板

工具及仿真模型 2

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