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特性
- 并行LVDS(DDR)输出
- 带内SFDR = 82 dBFS（340 MHz时，500 MSPS）
- 带内SNR = 67.8 dBFS（340 MHz时，500 MSPS）
- 500 MSPS时每通道总功耗：1.1 W（默认设置）
- 噪声密度 = −153 dBFS/Hz (500 MSPS)
- 直流电源：1.25 V、2.50 V和3.3 V
- 灵活的输入范围
1.46 V p-p至2.06 V p-p（标称值2.06 V p-p） - 95 dB通道隔离/串扰
- 幅度检测位支持实现高效自动增益控制(AGC)
- 噪声整形再量化器(NSR)选项支持主接收机功能
- 欲了解更多特性，请参考数据手册
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AD6679是一款135 MHz带宽混合信号中频(IF)接收机。内置双通道、14位、500 MSPS模数转换器(ADC)和各种数字信号处理模块，包括四个宽带DDC、一个NSR和VDR监控。 它具有片内缓冲器和采样保持电路，专门针对低功耗、小尺寸和易用性而设计。 该产品设计支持通信应用，能够实现高达2 GHz的宽带宽模拟信号采样。 AD6679针对宽输入带宽、高采样速率、出色的线性度和小封装低功耗而优化。
这款双通道ADC内核采用多级、差分流水线架构，并集成了输出纠错逻辑。 每个ADC均具有宽带宽输入，支持用户可选的各种输入范围。 集成基准电压源可简化设计。
应用
- 分集多频段、多模数字接收机
3G/4G、TD-SCDMA、W-CDMA、GSM、LTE-A - DOCSIS 3.0 CMTS上游接收路径
- HFC数字反向路径接收机
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AD6679
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参考资料
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| 产品型号 | 引脚/封装图-中文版 | 文档 | CAD 符号，脚注和 3D模型 |
|---|---|---|---|
| AD6679BBPZ-500 |
196-Ball BGA (12mm x 12mm x 1.38mm w/ EP)
|
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| AD6679BBPZRL7-500 |
196-Ball BGA (12mm x 12mm x 1.38mm w/ EP)
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- AD6679BBPZ-500
- 引脚/封装图-中文版
-
196-Ball BGA (12mm x 12mm x 1.38mm w/ EP)
- 文档
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Material Declaration
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Reliablity Data
- CAD 符号，脚注和 3D模型
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Ultra Librarian
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SamacSys
- AD6679BBPZRL7-500
- 引脚/封装图-中文版
-
196-Ball BGA (12mm x 12mm x 1.38mm w/ EP)
- 文档
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- CAD 符号，脚注和 3D模型
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SamacSys
评估套件 2
EVAL-AD6679
AD6679 评估板
产品详情
AD6679数据手册提供了更多信息，在使用评估板时应加以参考。 所有文档和软件工具可从此处下载：www.analog.com/hsadcevalboard。 欲了解更多信息，或有任何疑问，请发送电子邮件至highspeed.converters@analog.com。
设备要求：
- 模拟信号源和抗混叠滤波器
- 采样时钟源
- 12V、6.5A开关电源（配有HSC-ADC-EVALEZ或配有ADS7-V2EBZ的SL POWER CENB1080A1251F01）
- 运行Windows®的PC
- USB 2.0端口
- AD6679-500EBZ板
- 基于FPGA的数据采集套件HSC-ADC-EVALEZ
- 基于FPGA的数据采集套件ADS7-V2EBZ（可选，但并不硬性要求）
ADS7-V2EBZ
基于FPGA的数据采集套件
产品详情