MAX9320
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MAX9320

1:2差動LVPECL/LVECL/HSTLクロックおよびデータドライバ

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3052: 1:2差動LVPECL/LVECL/HSTLクロックおよびデータドライバ Data Sheet

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製品モデル 2
1Ku当たりの価格 最低価格：$4.99
特長
  • MC10LVEP11の改良型セカンドソース(MAX9320)
  • 差動HSTL/LVPECLの動作電圧：+2.25V～+3.8V
  • LVECLの動作電圧：-2.25V～-3.8V
  • 低消費電流：22mA (typ)
  • デバイス間スキュー：20ps (typ)
  • 出力間スキュー：6ps (typ)
  • 伝搬遅延：208ps (typ)
  • 出力：300mV (min) (3GHz時)
  • 入力のオープン時に出力をローに設定
  • ESD保護：2kV以上(ヒューマンボディモデル)
  • 熱強化された裏面放熱パッド付SOパッケージ
製品概要
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MAX9320/MAX9320Aは、クロック/データ分配用に設計された低スキュー、1:2差動ドライバです。入力は、2つの差動出力でリピートされます。外部リファレンス電圧を印加することによって、シングルエンド入力信号を受け入れるように差動入力を対応させることができます。

MAX9320/MAX9320Aは、30mA (max)の消費電流で超低伝搬遅延(208ps)、デバイス間スキュー(20ps)、および出力間スキュー(6ps)を備えており、これらのデバイスはクロック分配に最適です。差動HSTL/LVPECL信号とのインタフェースの場合は、これらのデバイスは+2.25V～+3.8Vの電源電圧範囲で動作し、+2.5Vまたは+3.3Vの公称電源電圧のシステムで高性能なクロック/データ分配を実現します。差動LVECL動作の場合は、これらのデバイスは-2.25V～-3.8Vの電源電圧で動作します。

MAX9320とMAX9320Aとの相違点は、ピン配置のみです。バックプレーン全体にわたる経路選択を簡素化する複数のピン配置が両面基板の両面に用意されています。

これらのデバイスは、省スペース8ピンSOT23、µMAX®、およびSOパッケージで提供されます。

アプリケーション

  • 低ジッタデータリピータ
  • 高精度クロック分配
  • 保護スイッチング
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MAX9320

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更新 11/12/2004
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MAX9320-MAX9320A: 1:2 Differential LVPECL/LVECL/HSTL Clock and Data Drivers Data Sheet (Rev.3)

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更新 01/01/1900
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信頼性データ

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更新 01/12/2023
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技術記事

5

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更新 03/28/2005
English
Schematic and Layout Guidelines for High-Speed Data Converters redirect icon

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更新 07/13/2005
中国語
高速数据转换器电路设计及布板指南 redirect icon

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更新 08/17/2005
日本語
高速データコンバータ用の回路図とレイアウトのガイドライン redirect icon

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更新 03/06/2003
English
An Introduction to Jitter in Communications Systems redirect icon

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更新 02/18/2003
English
Applying HSTL Signals to PECL Input Devices redirect icon

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アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ･デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。


本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.G）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

ドキュメント

技術資料 6
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データシート 2

MAX9320-MAX9320A: 1:2 Differential LVPECL/LVECL/HSTL Clock and Data Drivers Data Sheet (Rev.3)
3052: 1:2差動LVPECL/LVECL/HSTLクロックおよびデータドライバ Data Sheet

信頼性データ 1

MAX9320 Reliability Data

技術記事 3

高速データコンバータ用の回路図とレイアウトのガイドライン
An Introduction to Jitter in Communications Systems
Applying HSTL Signals to PECL Input Devices
アナログ・デバイセズは、最高レベルの品質と信頼性を満たす製品を供給することを常に最重要視しています。これを実現するため、製品、プロセス設計、更には製造プロセスに対しあらゆる観点から品質と信頼性のチェックを行っています。アナログ・デバイセズでは出荷製品に対する「ゼロ・ディフェクト」を常に目指しています。詳細については、アナログ・デバイセズの品質および信頼性プログラム、認証のページを参照してください。
製品モデル ピン／パッケージ図 資料 CADシンボル、フットプリント、および3Dモデル
MAX9320EUA+ Micro-MAX, Thin Shrink Small-Outline external-link
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MAX9320EUA+T Micro-MAX, Thin Shrink Small-Outline external-link
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1:10差動LVPECL/LVECL/HSTLクロックおよびデータドライバ

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デュアル1:5差動LVPECL/LVECL/HSTLクロックおよびデータドライバ

レベル変換器2
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デュアル1:5差動LVPECL/LVECL/HSTLクロックおよびデータドライバ

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