LT1057
LT1057
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製造中
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よく聞かれる質問（FAQ）
製品モデル
6
1Ku当たりの価格
最低価格：$2.62
特長
- 14/μSスルーレート：10V/μS最小
- 5MHzの利得帯域幅積
- 高速セトリング時間：1.3μSで0.02%
- 150μVのオフセット電圧(LT1057)：450μV最大
- 180μVのオフセット電圧(LT1058)：600μV最大
- 2μV/℃のVOSのドリフト：7μV/℃最大
- 70℃での50pAのバイアス電流
- 低電圧ノイズ：
- 13nV/√Hz@1kHz
- 26nV/√Hz@10Hz
製品概要
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LT1057は、マッチングされたJFET入力のデュアル・オペアンプで、高精度仕様と高速性能を兼ね備えており、業界標準の8ピン・パッケージで供給されます。広く用いられているポピュラーなあらゆるバイポーラおよびJFET入力のデュアル・オペアンプに取って代わります。特にLT1057はLF412AおよびOP-215JFET入力デュアル・オペアンプを使用したシステムの性能をグレードアップします。
LT1058は標準14ピン構成の最もオフセットが低いクワッドのJFET入力オペアンプです。現在入力可能なJFET入力クワッド・オペアンプと比較して、大幅に精度を向上させます。4個のシングル高精度JFET入力のオペアンプを置き換え、同時にボード・スペース、消費電力、およびコストを節減することができます。
LT1057とLT1058は両方とも、プラスチックDIP、SOPの標準パッケージで供給されます。
アプリケーション
- 高精度、高速計測
- 高速、高精度サンプル&ホールド
- 対数アンプ
- D/A出力アンプ
- フォトダイオード・アンプ
- 電圧－周波数コンバータ
- 周波数－電圧コンバータ
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よく聞かれる質問（FAQ）
製品モデル
6
1Ku当たりの価格
最低価格：$2.62
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-
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LT1057
資料
12
Filters
1つが該当
すべて
-
すべて
-
デザイン・ノート
-
アプリケーション・ノート
-
データシート
-
信頼性データ
すべて
-
すべて
-
English
-
日本語
データシート
2
デザイン・ノート
6
更新 06/28/2016
English
更新 08/20/2007
English
更新 06/28/2016
English
更新 07/28/2014
English
更新 02/21/2008
日本語
HTML
更新 10/01/1996
English
アプリケーション・ノート
3
更新 07/10/2012
English
AN43 - Bridge Circuits
3.00M
更新 08/20/2007
English
HTML
更新 11/16/2020
English
信頼性データ
1
更新 03/26/2018
English
R040 Reliability Data
21.27 K
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利用上の注意
アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ･デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。
本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。
なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.G）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。
ドキュメント
技術資料
11
データシート 2
信頼性データ 1
アプリケーション・ノート 3
デザイン・ノート 5
DN140 最適なノイズ特性のための最新オペアンプ選択ガイド
DN3 - Operational Amplifier Selection Guide for Optimum Noise Performance
DN6 - Operational Amplifier Selection Guide for Optimum Noise Performance
DN15 - Noise Calculations in Op Amp Circuits
Design Note 140: Updated Operational Amplifier Selection Guide for Optimum Noise Performance
設計リソース 6
| 製品モデル | ピン／パッケージ図 | 資料 | CADシンボル、フットプリント、および3Dモデル |
|---|---|---|---|
| LT1057ACN8#PBF |
8-Lead PDIP (Narrow 0.3 Inch)
|
|
|
| LT1057CN8#PBF |
8-Lead PDIP (Narrow 0.3 Inch)
|
|
|
| LT1057IS8#PBF |
8-Lead SOIC (Narrow 0.15 Inch)
|
|
|
| LT1057IS8#TRPBF |
8-Lead SOIC (Narrow 0.15 Inch)
|
|
|
| LT1057S8#PBF |
8-Lead SOIC (Narrow 0.15 Inch)
|
|
|
| LT1057S8#TRPBF |
8-Lead SOIC (Narrow 0.15 Inch)
|
|
- LT1057ACN8#PBF
- ピン／パッケージ図
-
8-Lead PDIP (Narrow 0.3 Inch)
- 資料
-
HTML
Material Declaration
-
HTML
Reliablity Data
- CADシンボル、フットプリント、および3Dモデル
-
Ultra Librarian
-
SamacSys
- LT1057CN8#PBF
- ピン／パッケージ図
-
8-Lead PDIP (Narrow 0.3 Inch)
- 資料
-
HTML
Material Declaration
-
HTML
Reliablity Data
- CADシンボル、フットプリント、および3Dモデル
-
Ultra Librarian
-
SamacSys
- LT1057IS8#PBF
- ピン／パッケージ図
-
8-Lead SOIC (Narrow 0.15 Inch)
- 資料
-
HTML
Material Declaration
-
HTML
Reliablity Data
- CADシンボル、フットプリント、および3Dモデル
-
Ultra Librarian
-
SamacSys
- LT1057IS8#TRPBF
- ピン／パッケージ図
-
8-Lead SOIC (Narrow 0.15 Inch)
- 資料
-
HTML
Material Declaration
-
HTML
Reliablity Data
- CADシンボル、フットプリント、および3Dモデル
-
Ultra Librarian
-
SamacSys
- LT1057S8#PBF
- ピン／パッケージ図
-
8-Lead SOIC (Narrow 0.15 Inch)
- 資料
-
HTML
Material Declaration
-
HTML
Reliablity Data
- CADシンボル、フットプリント、および3Dモデル
-
Ultra Librarian
-
SamacSys
- LT1057S8#TRPBF
- ピン／パッケージ図
-
8-Lead SOIC (Narrow 0.15 Inch)
- 資料
-
HTML
Material Declaration
-
HTML
Reliablity Data
- CADシンボル、フットプリント、および3Dモデル
-
Ultra Librarian
-
SamacSys
PCN/PDN情報
モデルでフィルタ
製品モデル
製品ライフサイクル
PCN
10 8, 2024
- 24_0234
Migrating Bottom Trace Code Marking to Top Side Laser Marking for PDIP Package
LT1057ACN8#PBF
製造中
LT1057CN8#PBF
製造中
10 11, 2022
- 22_0241
Epoxy Change from Henkel 8290 to 8290A for PDIP Package
LT1057ACN8#PBF
製造中
LT1057CN8#PBF
製造中
8 6, 2022
- 22_0172
Laser Top Mark Conversion for PDIP Packages Assembled in ADPG [PNG]
LT1057ACN8#PBF
製造中
LT1057CN8#PBF
製造中
10 8, 2024
- 24_0236
Migrating Bottom Trace Code Marking to Top Side Laser Marking for SOIC_N Package
LT1057IS8#PBF
製造中
LT1057IS8#TRPBF
製造中
LT1057S8#PBF
製造中
LT1057S8#TRPBF
製造中
10 12, 2022
- 22_0254
Epoxy Change from Henkel 8290 to 8290A for 8-Lead SOIC Package (PCN part 1 of 2)
LT1057IS8#PBF
製造中
LT1057IS8#TRPBF
製造中
LT1057S8#PBF
製造中
LT1057S8#TRPBF
製造中
6 11, 2021
- 21_0060
Laser Top Mark for 8SOICN Assembled in ADPG, UTL and CRM
LT1057IS8#PBF
製造中
LT1057IS8#TRPBF
製造中
LT1057S8#PBF
製造中
LT1057S8#TRPBF
製造中
モデルでフィルタ
製品モデル
製品ライフサイクル
PCN
10 8, 2024
- 24_0234
Migrating Bottom Trace Code Marking to Top Side Laser Marking for PDIP Package
10 11, 2022
- 22_0241
Epoxy Change from Henkel 8290 to 8290A for PDIP Package
LT1057ACN8#PBF
製造中
LT1057CN8#PBF
製造中
8 6, 2022
- 22_0172
Laser Top Mark Conversion for PDIP Packages Assembled in ADPG [PNG]
LT1057ACN8#PBF
製造中
LT1057CN8#PBF
製造中
10 8, 2024
- 24_0236
Migrating Bottom Trace Code Marking to Top Side Laser Marking for SOIC_N Package
LT1057IS8#PBF
製造中
LT1057IS8#TRPBF
製造中
LT1057S8#PBF
製造中
LT1057S8#TRPBF
製造中
10 12, 2022
- 22_0254
Epoxy Change from Henkel 8290 to 8290A for 8-Lead SOIC Package (PCN part 1 of 2)
LT1057IS8#PBF
製造中
LT1057IS8#TRPBF
製造中
LT1057S8#PBF
製造中
LT1057S8#TRPBF
製造中
6 11, 2021
- 21_0060
Laser Top Mark for 8SOICN Assembled in ADPG, UTL and CRM
LT1057IS8#PBF
製造中
LT1057IS8#TRPBF
製造中
LT1057S8#PBF
製造中
LT1057S8#TRPBF
製造中
ソフトウェアおよび製品のエコシステム
ツールおよびシミュレーション 1
LTspice
1
LTspice®は、無料で提供される強力で高速な回路シミュレータと回路図入力、波形ビューワに改善を加え、アナログ回路のシミュレーションを容易にするためのモデルを搭載しています。
LTspiceデモ用回路集の実行方法
ステップ1: LTSpiceをダウンロードし、インストールしてください。
ステップ2: 下のセクションのリンクをクリックし、デモ用回路をダウンロードしてください。
ステップ3: 下のリンクをクリックしてもLTSpice が自動的に開かない場合は、リンクを右クリックし、“Save Target As”（対象をファイルに保存）を選択する方法でもシミュレーションを実行できます。ファイルを保存したら、LTSpiceを起動し、"File"メニューから"Open"を選択してデモ用回路を開いてください。
Lt Spice
