製品概要
機能と利点
- 2つの選択可能差動アナログ入力
- 4.8GHzの動作周波数
- ランダム広帯域ジッタ：75fsrms
- 入力終端の内蔵
- 電源電圧: 3.3 V
製品概要
ADCLK950は、超高速のクロック・ファンアウト・バッファで、アナログ・デバイセズの独自のXFCB3シリコン・ゲルマニューム（SiGe）バイポーラ・プロセスで製造されています。このデバイスは、低ジッタを必要とする高速アプリケーション用として設計されています。
このデバイスは、IN_SEL制御ピンを介して2つの選択できる差動入力を備えています。両方の入力には、センタータップされた、差動の100Ω終端抵抗がオンチップで備わっています。入力は、dc結合のLVPECL、CML、3.3VCMOS（シングルエンド）、ac結合の1.8VCMOS、LVDS、LVPECL入力に対応します。VREFXピンはac結合入力のバイアッシングとして使うことができます。
ADCLK950は、10個のフルスイング・エッミタ・カップル・ロジック（ECL）出力ドライバを特長としています。LVPECL（正のECL）動作では、バイアスVccと正側電源、VEEとグランドで動作します。ECLは、バイアスVccからグランドと、VEEから負側電源で動作します。
出力段は、両端子で800mVを直接ドライブできるように設計されており、1.6Vのトータル差動出力振幅のためにVcc-2Vに50Ωで終端されています。
ADCLK950は、40ピンLFCSPパッケージを採用し、-40℃～+85℃の標準工業用温度範囲にわたって動作が仕様規定されています。
アプリケーション
- 低ジッタのクロック分配
- クロックとデータの信号再生
- レベル変換
- ワイヤレス通信
- 有線通信
- 医療および工業用画像処理
- ATEと高性能計測機器
製品カテゴリ
マーケット＆テクノロジー
製品ライフサイクル
新規設計にお薦めします
発売済みの製品です。データシートには、最終的な仕様と動作条件がすべて記載されています。新規の設計には、これらの製品の使用を推奨します。
参考資料
-
UG-067: Setting Up the Evaluation Board for the ADCLK95011/16/2009PDF217 kB
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MT-008: Converting Oscillator Phase Noise to Time Jitter2/14/2015PDF123 kB
ツールおよびシミュレーション
設計ツール
ADIsimCLK 設計・評価 ソフトウェア
ADIsimCLKはアナログ・デバイセズの超低ジッタのクロック分配器とクロック生成用製品向けに開発された設計ツールです。ADIsimCLKを使用すれば、ワイヤレス・インフラストラクチャ、計測器、ネットワーキング、ブロードバンド、ATE（自動試験装置）あるいはクロック性能が予測可能であることが求められるあらゆる分野のアプリケーションで、設計を迅速に開発、評価、最適化できます。
設計リソース
アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。詳細についてはアナログ・デバイセズの品質および信頼性プログラム/認定証をご覧ください。
| 製品番号 | 材料宣誓書（MD） | 信頼性データ | ピン/パッケージ図 | CADシンボル、フットプリント & 3Dモデル |
|---|---|---|---|---|
| ADCLK950BCPZ | 材料宣誓書（MD） | 信頼性データ | 40-Lead LFCSP (6mm x 6mm w/ EP) | |
| ADCLK950BCPZ-REEL7 | 材料宣誓書（MD） | 信頼性データ | 40-Lead LFCSP (6mm x 6mm w/ EP) | |
| ウェハ・ファブリケーション・データ |
PCN-PDN情報
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サポート ＆ ディスカッション
ADCLK950 Discussions
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