ADRV9010
新規設計に推奨内蔵のオブザベーション・パス付きクワッドRFトランシーバー
- 製品モデル
- 3
- 1Ku当たりの価格
- 最低価格：$1020.78
製品の詳細
- 差動トランスミッタ4個
- 差動レシーバー4個
- 2入力のオブザベーション・レシーバー各2個
- センター周波数：
- 650MHz～3800MHz（ADRV9010BBCZ）
- 650MHz～6000MHz（ADRV9010BBCZ-A）
- レシーバー最大帯域幅：200MHz
- トランスミッタ最大帯域幅：200MHz
- トランスミッタ・シンセシス最大帯域幅：450MHz
- オブザベーション・レシーバー最大帯域幅：450MHz
- 独立したフラクショナルN無線周波数シンセサイザをすべて内蔵
- クロック・シンセサイザをすべて内蔵
- すべての局部発振器およびベースバンド・クロック用マルチチップ位相同期
- JESD204B/JESD204Cデジタル・インターフェース
ADRV9010は、高度に統合化された無線周波数（RF）のアジャイル・トランシーバーです。個別に制御可能なトランスミッタ4個、各トランスミッタ・チャンネル監視専用のオブザベーション・レシーバー入力、個別に制御可能なレシーバー4個、内蔵シンセサイザ、デジタル信号処理回路を搭載し、フル機能のトランシーバー・ソリューションを提供します。また、スモール・セル基地局無線、マクロTDD/3G/4Gシステム、MIMO（Massive Multiple Input Multiple Output）基地局などのセルラ・インフラストラクチャ・アプリケーションに必要な性能を発揮します。ADRV9010BBCZは 650MHz～3800MHzで動作し、認可および無認可のセルラ帯域のほとんどをカバーします。ADRV9010BBCZ-Aは、650MHz～6000MHzで動作します。
レシーバー・サブシステムは、最先端のダイナミック・レンジを持つ4つの独立した広帯域幅ダイレクト・コンバージョン・レシーバーで構成されています。4つの独立したトランスミッタは、高い変調精度を例外的な低ノイズで実現する、革新的なダイレクト・コンバージョン変調器を使用します。ADRV9010にはこのほか、各トランスミッタ出力を監視するための2つの入力を備えた、広帯域幅の時間共有オブザベーション・パス・レシーバーも2つ塔載されています。
全機能内蔵型トランシーバー・サブシステムは、自動および手動の減衰制御、DCオフセット補正回路、直交誤差補正回路（QEC）、およびデジタル・フィルタリングを内蔵しているため、デジタル・ベースバンドにこれらの機能は不要です。また、多数のデジタル制御オプションを提供するA/Dコンバータ（ADC）、D/Aコンバータ（DAC）、汎用入出力（GPIO）などの補助機能も搭載しています。
高レベルのRF性能を実現するため、トランシーバーには、全機能内蔵のフェーズ・ロック・ループ（PLL）が5個搭載されています。PLLのうち2個は、トランスミッタとレシーバー信号パスに対して高性能かつ低消費電力のフラクショナルN-RF周波数シンセシスを提供します。完全に統合されたもう1個のPLLも、オブザベーション・レシーバー用の独立した局部発振器（LO）モードをサポートしています。残るPLLのうち1個は、コンバータとデジタル回路に必要なクロックを発生させ、5個目のPLLはシリアル・データ・インターフェース用のクロックを発生させます。マルチチップ同期メカニズムは、複数のADRV9010チップ間ですべての局部発振器（LO）とベースバンド・クロックの位相を同期します。また、すべての電圧制御発振器（VCO）とループ・フィルタの構成要素が内蔵されており、デジタル制御インターフェースで調節できます。
シリアル・データ・インターフェースは、8つのシリアライザ・レーンと8つのデシリアライザ・レーンで構成されています。最大16.22016Gbpsのデータ・レートで動作するJESD204B規格およびJESD204C規格の両方をサポートしています。また、低帯域幅用にインターリーブ・モードをサポートすることで、高速データ・インターフェース・レーン数を1個に削減しています。データ・フォーマットは、固定小数点と浮動小数点両方をサポートしています。浮動小数点フォーマットを選択すると、内部自動ゲイン制御（AGC）が復調器デバイスから見られなくなります。
ADRV9010は1.0V、1.3V、1.8Vのレギュレータから直接給電し、標準シリアル・ペリフェラル・インターフェース（SPI）を介して制御できます。また、包括的パワーダウン・モードが搭載されているため、通常使用の消費電力を最小化できます。ADRV9010は、14mm × 14mm、289ボールのチップ・スケール・ボール・グリッド・アレイ（CSP_BGA）パッケージを採用しています。
アプリケーション
- 3G/4G/5G TDDマクロ・セルおよびスモール・セル基地局
- 最先端のLTEおよび5G向けTDDアクティブ・アンテナ・システム
テクニカル・サポートについては、ADRV9010 EngineerZone® フォーラムに質問を直接投稿するか、ADRV9010テクニカル・サポートまでメールでお問い合わせください。メールで送っていただいた質問も、ADRV9010 EngineerZone®フォーラムで回答させていただきますのでご注意ください。
ドキュメント
ビデオ 1
製品選択ガイド 1
| 製品モデル | ピン／パッケージ図 | 資料 | CADシンボル、フットプリント、および3Dモデル |
|---|---|---|---|
| ADRV9010BBCZ | 289-Ball CSPBGA (14 mm x 14 mm x 1.34 mm) | ||
| ADRV9010BBCZ-A | 289-Ball CSPBGA (14 mm x 14 mm x 1.34 mm) | ||
| ADRV9010BBCZ-REEL | 289-Ball CSPBGA (14 mm x 14 mm x 1.34 mm) |
これは最新改訂バージョンのデータシートです。
ソフトウェア・リソース
評価用ソフトウェア 2
ADRV9010 Release Build Software Release Notes (PDF) SW4.1.0.84
The SW4.1.0.84 release build provides ARM firmware, stream files, API, and GUI software to support the ADRV9010.
ADRV9010 Released Software SW4.1.0.84
The ADRV9010 software package contains the GUI software, the API source code, the firmware file, and the gain tables. The GUI software enables transceiver testing using the evaluation board and the Windows GUI. The API source code is intended for use in a customer system and can be integrated with the rest of the customer code and compiled for the target system. The firmware file in binary format is used by the ARM® processor on the transceivers. The gain tables include the receiver gain tables and transmitter attenuation table. Note that the files within the zip must be used together. For example, the ARM files from one zip file cannot be used with the API files from another version.
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ツールおよびシミュレーション
設計ツール 1
ADIsimRF
ADIsimRFは使いやすいRFシグナル・チェーン計算ツールです。最大50段までのシグナル・チェーンについて、カスケード・ゲイン、ノイズ、歪み、消費電力を計算し、プロット、エクスポートが可能です。ADIsimRFには、アナログ・デバイセズのRFおよびミックスド・シグナル部品のデバイス・モデルの広範なデータ・ベースも含まれています。
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