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演示电路 1075B 是与高速 ADC 结合使用的 2/4/8 分频时钟分频器。每个组件包括一个时钟分频器,和一个后随的的用于产生陡峭时钟边沿的重定时级。在功能上,DC1075B 接收一个高频正弦波,该正弦波被衰减并传入时钟分频器。然后,时钟分频器的输出被传送到一个 D 触发器重定时级。该 D 触发器由原始高频正弦波计时。这对于确保信号完整性是至关重要的。该重定时级的输出是适合用作高速 ADC 之时钟源的 CMOS 信号。

另外,该电路还是一种用于那些需使用 FPGA (其充当时钟分频器) 之设计的模型。每当进行此设计时,都需要采用 D 触发器重定时级来确保提供低抖动时钟信号。

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