Analog Dialogue: A forum for the exchange of circuits, systems, and software for real-world signal processing.
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DDS设置避免器件初始化期间产生杂散输出

AN-1108:AD9832/AD9835编程示例

这篇4页的应用笔记介绍如何在直接数字频率合成器AD9832/AD9835的输出上载入正弦波形,包括上电时的设置、FSELECT控制位设置,以及在使用FSELECT控制位时将新数据载入器件。

边带抑制降低误差矢量幅度和比特误差率

AN-1100:无线发射机IQ平衡和边带抑制

直接变频是指直接将数模转换器输出的IQ信号调制到RF载波上,从而无需中间IF级和相关滤波。因此,直接复数调制是蜂窝基站、WiMAX和无线点到点应用中的发射机的首选架构。在模拟调制过程中,IQ信号的增益和相位不匹配会直接影响边带抑制,导致误差矢量幅度(EVM)降低和比特误差率(BER)提高。这篇8页的应用笔记讨论造成边带抑制不理想的主要原因,以及有关器件选择和PCB设计/布局的设计考虑。

窄带滤波器降低ADC与差分放大器驱动器之间的噪声

AN-1098:高性能差分驱动放大器与ADC之间的窄带接口设计方法

高性能差分放大器ADL5561、ADL5562、AD8375、AD8376和AD8352是对低失真、低噪声和低功耗有严格要求的一般中频与宽带应用的理想放大器。除了宽带宽和低失真外,这些放大器还具有增益调整能力,非常适合驱动模数转换器(ADC)。通过在驱动放大器与ADC之间设计一个窄带带通抗混叠滤波器接口,目标奈奎斯特频率区域外的放大器输出噪声得以衰减,有助于保持ADC的可用SNR性能。一般而言,若用一个恰当阶数的抗混叠滤波器,SNR性能会提高数个dB。这篇6页的应用笔记介绍了一种接口设计方法,利用它可以实现高性能驱动放大器与ADC(包括采用开关电容输入的ADC)之间的更有效接口。本应用笔记所述的窄带接口方法针对驱动一些颇受欢迎的无缓冲输入ADC进行了优化,如AD9246、AD9640和AD6655等。

波束导引和其它多通道应用中的DAC输出同步

AN-1093:多个AD9122 TxDAC+转换器的同步

双通道和四通道16位高动态范围数模转换器(DAC) AD912x具有最高达1230MSPS的采样速率和多芯片同步功能,来自多个器件的DAC输出能够在一个DAC时钟周期内实现同步。有两种同步模式可用。这篇12页的应用笔记说明了这两种模式的差异,以及何时和如何使用AD9122、AD9125和AD9148 TxDAC+®转换器的同步功能。

可编程时序控制器控制线路卡和刀片卡的上电

AN-1086:ADM106x的热插拔应用

超级时序控制器系列ADM106x super sequencers®能够精确监控多个输入轨,ADM1062至ADM1067有10个专用输入引脚,ADM1068和ADM1069有8个专用输入引脚。各引脚具有两个内部可编程比较器电路。可以将这些电路编程为仅欠压、仅过压或欠压/过压模式,从而针对各个受监控的电源设置跳变点。ADM106x内置一个电源仲裁器,它能自动从其输入电源引脚上的最高电压轨为器件供电。这些器件通常用于电信基础设施(中央交换局和基站)线路卡和服务器刀片卡等需要热插拔到带电背板的应用。在线路卡应用中,ADM106x可能需要是电路板上第一个上电的器件,因为它必须监控电路板上的输入电源;如果电源在设定限值以内,则向热插拔控制器提供一个使能信号,从而允许电路板的主要部分上电。这篇2页的应用笔记描述卡片在带电背板中热插拔的情况下,ADM106x的输入电源接通时必须考虑的设计要求。

无线电控制器代码模块使ADF7242收发器IC支持自动IEEE 802.15.4工作模式

AN-1082:自动IEEE 802.15.4工作模式

AN-1082 RCCM IEEEX代码

这篇12页的应用笔记描述ADF7242收发器IC的自动IEEE 802.15.4工作模式。无线电控制器代码模块支持这些模式,并使ADF7242具备下列特性:自动IEEE 802.15.4帧滤波,自动应答已接收的有效IEEE 802.15.4帧,以及带自动重试功能的自动帧传输。

使用直接数字频率合成器或可编程波形发生器产生正弦波形

AN-1070:对AD9833/AD9834进行编程

这篇4页的应用笔记说明如何对AD9833可编程波形发生器和AD9834直接数字频率合成器(DDS)的正弦波形输出进行编程。操作顺序为进入复位模式、将数据输入Freq0寄存器以及退出复位模式。

通过管理噪声、杂散和电源提高时钟性能

AN-1066:低噪声时钟AD9523、AD9524和AD9523-1的电源考虑

AD9523、AD9524和AD9523-1系列低噪声、低功耗时钟产品提供单芯片解决方案,具有出色的集成度、性能和功耗特性。这篇11页的应用笔记旨在帮助用户了解电源管理设计如何影响该系列器件的性能。它还详细说明了系统板布局和频率规划,并讨论了系统板设计过程中应当考虑的噪声和耦合情况,以确保了解所有噪声和杂散影响。

利用基准电压监控器及早检测缓慢或丢失基准电压

AN-1064:了解AD9548的输入基准电压监控器

AD9548 PLL的输入端最多可支持八个独立参考时钟信号。八路输入各有一个专用基准电压监控器,判断输入信号的周期是否满足用户要求。基准电压监控器测量输入参考信号的周期,如果基准电压有误,则声明信号是过慢还是过快。此信息驻留于基准电压状态寄存器内。虽然基准电压监控器将既不快也不慢的基准电压视为正确,但仍会通过基准电压验证逻辑进一步审查。所有八个基准电压监控器共用相同的采样时钟和用户提供的标称系统时钟周期值(TSYS)。这篇12页的应用笔记将详细介绍基准电压监控器。

利用可编程数字鉴频鉴相器补偿抖动的不利影响

AN-1061:存在随机抖动时鉴频鉴相器AD9548的特性

在AD9548 PLL中,直接数字频率合成器(DDS)的作用相当于模拟PLL中的VCO。数字鉴频鉴相器(DPFD)并不参与相位和频率采集过程,仅指示PLL控制环路何时达到锁定条件。DPFD具有两个输出信号:时间误差样本代表基准电压与反馈沿之间的时间差异;周期误差样本代表基准电压与反馈沿之间的周期差异。该鉴频鉴相器具有数字特性,因而能够提供编程选项,比相应的模拟器件更加灵活。这篇16页的应用笔记有助于了解编程参数(锁定阈值、填充速率和漏极速率)与输入信号抖动特征之间的关系,便于用户充分利用鉴频鉴相器的灵活性。

实验室电路

采用低压(3 V)电源供电的高压(30 V) DAC产生用于天线和滤波器的调谐信号(CN0193)

本电路可产生高压信号,用于控制BST(钛酸钡锶)电容的电容量。BST常用于调谐天线阵列和可调滤波器。此类应用需要一个方便、紧凑、低成本的电路来产生高压电源,仅为了该功能添加独立电源通常并不实用。采用ADP1613升压转换器和AD5504 30 V/60 V DAC可满足上述要求。

相位相干FSK调制器(CN0186)

标准的单通道直接数字频率合成器(DDS)不会以相位相干形式在不同频率之间切换。根据设计,DDS频率转换具有相位连续性,而不相干。不过,本电路展示了如何配置AD9958/AD9959多通道DDS,通过叠加多通道DDS输出实现稳定的相位相干FSK(频移键控)调制器。

新产品简介

June 2011

Dual 16-bit, 1230-Msps TxDAC+ Digital-to-Analog Converter

ad9146The AD9146 dual 16-bit, 1230-Msps TxDAC+® digital-to-analog converter enables multicarrier signal generation at frequencies up to Nyquist. Optimized for direct-conversion transmit applications, it includes complex digital modulation and offset/gain compensation. The 2×/4× interpolator/complex modulator enables carrier placement anywhere within the DAC bandwidth. The DAC outputs interface seamlessly with quadrature modulators in the ADL537x F-MOD series; full-scale output current can be programmed in the 8.7 mA to 31.7 mA range. The flexible LVDS interface allows byte- or nibble load—reducing pin count, cost, and PCB area. Operating on 1.8-V and 3.3-V supplies, the AD9146 dissipates 864 mW at 500 Msps and 8.5 mW in power-down mode. Available in a 48-lead LFCSP package, it is specified from –40°C to +85°C and priced at $29.95 in 1000s.

Low-power Complete DDS

ad9838The AD9838 low-power complete DDS produces high-performance sine and triangular outputs; and an on-chip comparator produces a low-jitter square wave output for clock generation. The 28‑bit frequency registers enable 0.06-Hz resolution with a 16-MHz clock and 0.02-Hz resolution with a 5-MHz clock. Phase- and frequency modulation are configured via registers using software or pin selection. Data is written via a 3-wire serial interface that clocks at up to 40 MHz. Operating with a single 2.3-V to 5.5-V supply, the AD9838 draws 3.7 mA in normal mode and 0.4 mA in sleep mode. Available in a 20-lead LFCSP package, it is specified from –40°C to +125°C and priced from $2.10 in 1000s.

Low-power, high-performance FSK Transceiver operates in ISM band

adf7023-1The ADF7023-J low-power, high-performance 2FSK/GFSK/MSK/GMSK transceiver operates in the 902-MHz to 958-MHz band, allowing short-range communications at 950-MHz, with data rates from 1 kbps to 300 kbps. The transmit RF synthesizer includes a VCO and a low-noise fractional-N PLL. It also includes two power amplifiers: a single-ended PA with output power programmable from –20 dBm to +13.5 dBm; and a differential PA with output power programmable from –20 dBm to +10 dBm. The ultra-linear receiver achieves –116-dBm sensitivity (BER) at 1-kbps with 2FSK/MSK modulation, –11.5-dBM third-order intercept (IP3), –21.9-dBm compression point (P1dB), and 72-dB interference blocking at 10-MHz offset. This combination allows secure communications in noisy environments, in applications such as smart metering, building control, and wireless healthcare. The high-speed AFC loop allows the PLL to find and correct frequency errors in the recovered packet; and an automated calibration engine enhances image rejection. Operating with a single 2.2-V to 3.6-V supply, the ADF7023‑J draws 10.3 mA in transmit mode, 22 µA in smart-wake mode, and 0.2 µA in deep-sleep mode. Available in a 32-lead LFCSP package, it is specified from –40°C to +85°C and priced at $2.62 in 1000s.

2011年5月

250 MHz数字预失真观测接收机

ad6641 AD6641数字预失真(DPD)观测接收机集成一个12位500 Msps ADC和、一个16K × 12 FIFO和一个多模式后端,支持通过串行端口(SPORT)、SPI接口或12位并行CMOS/6位DDR LVDS端口检索数据。它具有出色的动态性能和低功耗特性,适合宽带宽电信应用。芯片上集成了全部必需功能,包括采样保持器和基准电压源,可提供250 MHz带宽的完整信号转换解决方案。片内FIFO可以在单次捕捉或连续捕捉模式下工作,允许通过ADC捕捉输入信号的短期历史记录以及以较低的速率进行回读,从而降低信号处理限制。AD6641采用1.8 V至2.0 V模拟和数字电源及1.8 V至3.3 V逻辑电源供电,正常模式下功耗为695 mW,待机模式下为72 mW,掉电模式下为15 mW。它采用56引脚LFCSP封装,额定温度范围为–40°C至+85°C,千片订量报价为124.95美元/片。

12位、370/500 MSPS流水线式ADC采用1.8 V电源供电

ad9434 AD9434 采样模数转换器针对高性能、低功耗和易用性进行了优化。它提供12位分辨率,转换速率最高可达500 MSPS,具有出色的动态性能,适合宽带载波和宽带系统使用。芯片上集成了全部必需功能,包括采样保持器和基准电压源,可提供完整的信号转换解决方案。数字输出为LVDS兼容,支持二进制补码、偏移二进制或格雷码格式。这款ADC需要一个差分时钟,并提供数据时钟输出以保持正确的输出数据时序。AD9434采用1.75 V至1.9 V电源供电,500 MSPS时的功耗为690 mW,待机模式下为40 mW,掉电模式下为2.5 mW。它采用56引脚LFCSP封装,额定温度范围为–40°C至+85°C,千片订量报价为85.00美元/片。

8位、500 MSPS流水线式ADC采用1.8 V电源供电

ad9484 AD9484 采样模数转换器针对高性能、低功耗和易用性进行了优化。它提供8位分辨率,转换速率最高可达500 MSPS,具有出色的动态性能,适合宽带载波和宽带系统使用。芯片上集成了全部必需功能,包括采样保持器和基准电压源,可提供完整的信号转换解决方案。数字输出为LVDS兼容,支持二进制补码、偏移二进制或格雷码格式。这款ADC需要一个差分时钟,并提供数据时钟输出以保持正确的输出数据时序。AD9484采用1.75 V至1.9 V电源供电,500 MSPS时的功耗为670 mW,待机模式下为40 mW,掉电模式下为2.5 mW。它采用56引脚LFCSP封装,额定温度范围为–40°C至+85°C,千片订量报价为36.00美元/片。

1200 MHz至2400 MHz正交调制器内置小数N分频PLL和VCO

adrf6702 ADRF6702正交调制器可以将带宽高达750 MHz的差分IF模拟输入(I/Q),转换为1200 MHz至2400 MHz的单端50 Ω RF输出。片内小数N分频PLL和VCO产生1050 MHz至2150 MHz范围内的本振(LO)。可将12 MHz至160 MHz范围内的参考输入乘以1或2,或者除以2或4,然后施加于PLL鉴相器。在2140 MHz时,该调制器可实现13.1 dBm的压缩点(P1dB)、29.1 dBm的三阶交调截点(OIP3)和–157.3-dBm/Hz的噪底。ADRF6702采用4.75 V至5.25 V电源供电,LO缓冲器使能时的功耗为290 mA,LO缓冲器禁用时的功耗为240 mA,使用外部LO时的功耗为130 mA,掉电模式下的功耗为2 µA。它采用40引脚LFCSP封装,额定温度范围为–40°C至+85°C,千片订量报价为12.10美元/片。

2011年4月

14位、2.5 Gsps电流输出RF DAC

ad9739a高性能DAC AD9739A在采样速率高达2.5 Gsps时可实现14位分辨率,支持在基带模式下产生高达奈奎斯特频率的多载波,在混频模式下产生达到第二和第三奈奎斯特区的多载波。双端口双倍数据速率LVDS接口支持高达1.25 Gsps的工作速率。电流输出可以配置为单端或差分拓扑结构,提供8.7 mA至31.7 mA的可编程满量程输出电流范围。线性度规格为±2 LSB DNL和±2.5 LSB INL。AD9739A采用1.8 V和3.3 V电源供电,2.5 Gsps时功耗为960 mW,2 Gsps时为770 mW,掉电模式下为20 mW。它采用160引脚CSP-BGA封装,额定温度范围为–40°C至+85°C,千片订量报价为43.69美元/片。

低功耗、零中频、2.4 GHz收发器IC支持IEEE 802.15.4

adf7241高集成度、低功耗、高性能收发器 ADF7241工作在全球通用的2.4 GHz ISM频段。在数据包和数据流两种模式下,该器件均支持IEEE 802.15.4-2006 PHY要求,并提供250 kbps的固定数据速率和DSSS-OQPSK调制功能。它符合FCC CFR47 Part 15、ETSI EN 300 440、ETSI EN 300 328和ARIB STD T-66标准。发射路径使用低噪声小数N分频RF频率合成器进行直接闭环VCO调制,其带宽自动优化,以实现最佳的相位噪声、调制质量和频率合成器建立时间性能。该VCO能够自动校准,工作频率是基频的两倍,因而可减少杂散发射并避免PA牵引效应。发射机输出功率可以在−20 dBm至+4 dBm范围内进行编程,且自动PA斜坡能力可满足瞬时杂散性能要求。集成的偏置和控制电路可简化与外部PA的接口。ADF7241采用1.8 V至3.6 V单电源供电,发射模式下功耗为21.5 mA,接收模式下为19 mA,休眠模式下为1.7 μA。它采用32引脚LFCSP封装,额定温度范围为–40°C至+85°C,千片订量报价为1.98美元/片。

双通道2.2 GHz至2.7 GHz平衡混频器包括LO缓冲器、IF放大器和RF巴伦

adl5354 ADL5354双通道平衡混频器将2200 MHz至2700 MHz范围内的RF输入与2230 MHz至3150 MHz范围内的本振(LO)相结合,以产生30 MHz至450 MHz范围内的IF输出。高线性度双平衡无源混频器内核、集成的RF与LO平衡电路以及片内RF巴伦支持实现单端工作。低泄漏、低交调失真以及高输入线性度使该混频器非常适合蜂窝基站应用。各混频器内核前接LO缓冲器和RF巴伦,后接高线性度IF缓冲放大器。两条开关LO路径可用于时域双工(TDD)应用。特性包括:8.6dB转换增益,10.6dB单边带噪声系数,26.1dBm输入三阶交调截点(IP3),以及10.6dBm输入压缩点(P1dB)。ADL5354采用3.0 V至3.6 V单电源供电,正常模式下功耗为200 mA,掉电模式下为300 μA。它采用36引脚LFCSP封装,额定温度范围为–40°C至+85°C,千片订量报价为9.98美元/片。

技术文章

Ashraf Elghamrawi, RF-IF Amplifiers and VGAs Cover The Entire Signal Chain, ECN, 5/12/2011

Pam Aparo, How are trends in wireless electronics affecting test and measurement?, ECN, 4/14/2011

Cosimo Carriero, Amplificatori Rf/If a guadagno variabile, Selezione di Elettronica , 4/1/2011

Yi Zhang, Wireless Transmitter IQ Balance and Sideband Suppression, Besprovodnie Technologii, 3/1/2011

Eamon Nash and Ashraf Elghamrawi, RF功率检波器同时提供均方根和包络输出, Microwave Journal, 2/1/2011

Eamon Nash and Ashraf Elghamrawi, 利用RF包络检波实现漏极调制系统, Wireless Design and Development, 2/1/2011

Henri Sino, 滤除电磁干扰以降低精密模拟应用的误差, Analog Dialogue, 1/11/2011

Ken Kavanagh, 升压电源和高压DAC为天线和滤波器提供调谐信号, Analog Dialogue, 12/13/2010

网络研讨会和教程

与RF器件接口 -- 对于任何成功的RF设计,接收机和发射机内各级的接口是最重要的事情之一。如果电路各级之间的连接不当,谐波、不良衰减和其它缺陷就会凸显出来。本研讨会将介绍有助于实现RF电路最高性能的最佳做法。

RF检波器揭秘 -- 本次在线研讨会将介绍有关RF检波器的一些实用知识,包括概述不同类型的检波器以及如何应用这些器件。涉及的应用领域包括:RF输入匹配、输入范围选择以及与精密ADC的接口。

直接变频接收机的正交和直流校正 --本研讨会讨论各种无线通信架构,重点探讨零差接收机设计挑战,例如直流偏置、正交误差和偶次谐波失真等。

 

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