ADSP-SC57x/ADSP-2157x Product Family

Процессор ADSP-SC573 — это представитель семейства продуктов SHARC^®. Он построен на базе двух ядер SHARC+ и ядра ARM^® Cortex^®-A5. Ядра цифровых сигнальных процессоров основаны на разработанной компанией Analog Devices супергарвардской архитектуре (Super Harvard Architecture, SHARC), поддерживающей операции в режиме SIMD (одна команда – много данных, single-instruction, multiple data). Эти 32-/40-/64-разрядные процессоры, оптимизированные для обеспечения высокой производительности в задачах обработки данных с плавающей точкой и в аудиосистемах, содержат большой объем статической оперативной памяти, множество внутренних шин, которые предотвращают возникновение узких мест при вводе/выводе данных, и инновационные цифровые аудиоинтерфейсы (DAI).  Новое ядро SHARC+ имеет набор команд, совместимый с процессорами SHARC предыдущих поколений, а также ряд усовершенствований архитектуры кэш-памяти и функцию предсказания ветвлений.

Благодаря интеграции передовых периферийных модулей и большого объема памяти, данные процессоры на базе ядер ARM Cortex-A5 и SHARC являются идеальной платформой для приложений, где требуется программная модель, близкая к процессорам RISC (reduced instruction set computing), поддержка мультимедийных данных и высокая производительность сигнальной обработки в рамках одного интегрированного корпуса. Подобные приложения могут возникать в самых различных областях, включая автомобильную промышленность, профессиональные аудиосистемы и промышленные системы, где требуется высокая производительность вычислений с плавающей точкой

Процессоры ADSP-SC57x/2157x являются представителями новых семейств высокопроизводительных, энергоэффективных процессоров с усовершенствованным ядром SHARC+^® и продвинутыми ускорителями операций цифровой обработки сигналов (DSP), таких как БПФ, КИХ и БИХ фильтры. Компоненты семейств ADSP-SC57x/ ADSP-2157x потребляют менее 2 Вт, обеспечивая более чем пятикратное повышение энергоэффективности по сравнению с продуктами SHARC предыдущих поколений и сопоставимые показатели в сравнении процессорами семейств SHARC ADSP-SC58x/ 2158x. Эта особенность позволяет получить наилучшую производительность цифровой обработки сигналов в задачах, где требования к отводу тепла ограничивают допустимую потребляемую мощность или где применение принудительного охлаждения невозможно из-за роста стоимости, либо уменьшения надежности при использовании вентиляторов. К возможным областям применения процессора относятся автомобильная промышленность, бытовая и профессиональная аудиоаппаратура, управление многоосевыми электродвигателями и системы распределения электроэнергии.

Процессоры семейства ADSP-2157x разработано для применения в задачах, где необходим сопроцессор ЦОС, и содержат два ядра SHARC+, а также оптимизированный набор периферийных модулей.

Новое, улучшенное, программно совместимое ядро SHARC+ работает с повышенной частотой и пониженным энергопотреблением, а также имеет аппаратную поддержку вычислений в формате с плавающей точкой двойной точности, специальные команды управления кэшем команд/данных и ряд других новых команд. Компоненты семейств ADSP-SC57x/2157x разработаны по технологии КМОП с малыми токами утечки, обеспечивающей малую потребляемую мощность, способны работать с частотой 450 МГц при температуре до 105°C и поддерживают дальнейшее развитие в направлении повышения производительности. Интеграция на кристалле более 2 Мбайт быстродействующей статической памяти SRAM и интерфейса DDR3/2/LP помогает достичь высокой эффективности вычислений в режиме реального времени, а подсистема памяти подверглась значительному улучшению и содержит усовершенствованные контроллеры DMA для одновременной пересылки данных.

Учитывая растущую потребность в защите интеллектуальной собственности в программном обеспечении, процессоры поддерживают технологию ARM^® TrustZone^® и содержат интегрированные криптографические аппаратные ускорители. Для задач, где критическим требованием является надежность, в процессорах реализована проверка четности при обращениях к памяти и аппаратное исправление ошибок, обеспечивающие повышенную целостность данных. Высокая степень интеграции и низкое энергопотребление новых процессоров ADSP-SC57x/ ADSP-2157x позволяют значительно сократить количество компонентов и занимаемое ими место на печатной плате, упростить и ускорить проектирование сложных современных систем.

Процессоры ADSP-SC57x/2157x поддерживаются удостоенным наград набором интерактивных инструментов проектирования Crosscore^® Embedded Studio компании Analog Devices, помогающих оптимизировать и ускорить процесс создания программных и аппаратных средств.

Кроме того, благодаря сотрудничеству компаний Analog Devices и Micrium пользователям доступны ядра операционных систем реального времени µC/OS-II^® и µC/OS-III^® для процессорного ядра SHARC+.

Совместимые эмуляторы ICE-1000/2000 упрощают создание, отладку и тестирование сложных приложений. Работая в связке с CrossCore Embedded Studio, эмуляторы обеспечивают поддержку всех JTAG-совместимых процессоров Analog Devices и используют технологию CoreSight™ компании ARM.

Процессоры ADSP-SC57x/2157x являются представителями семейства процессоров SHARC^®. Процессоры ADSP-SC57x включают в себя ядра SHARC+^® и ARM^® Cortex^®-A5. Ядра цифровых сигнальных процессоров основаны на разработанной компанией Analog Devices супергарвардской архитектуре (Super Harvard Architecture, SHARC), поддерживающей операции в режиме SIMD (одна команда – много данных, single-instruction, multiple data). Эти 32-/40-/64-разрядные процессоры, оптимизированные для обеспечения высокой производительности в задачах обработки данных с плавающей точкой и в аудиосистемах, содержат большой объем статической оперативной памяти, множество внутренних шин, которые предотвращают возникновение узких мест при вводе/выводе данных, и инновационные цифровые аудиоинтерфейсы (DAI). Новое ядро SHARC+ имеет набор команд, совместимый с процессорами SHARC предыдущих поколений, а также ряд усовершенствований архитектуры кэш-памяти и функцию предсказания ветвлений.

Благодаря интеграции передовых периферийных модулей и большого объема памяти, данные процессоры на базе ядер ARM Cortex-A5 и SHARC являются идеальной платформой для приложений, где требуется программная модель, близкая к процессорам RISC (reduced instruction set computing), поддержка мультимедийных данных и высокая производительность сигнальной обработки в рамках одного интегрированного корпуса. Подобные приложения могут возникать в самых различных областях, включая автомобильную промышленность, профессиональные аудиосистемы и промышленные системы, где требуется высокая производительность вычислений с плавающей точкой

Процессоры ADSP-SC57x/ADSP-2157x являются представителями семейства процессоров SHARC^®. Процессоры ADSP-SC57x включают в себя ядра SHARC+^® и ARM^® Cortex^®-A5. Ядра цифровых сигнальных процессоров основаны на разработанной компанией Analog Devices супергарвардской архитектуре (Super Harvard Architecture, SHARC), поддерживающей операции в режиме SIMD (одна команда – много данных, single-instruction, multiple data). Эти 32-/40-/64-разрядные процессоры, оптимизированные для обеспечения высокой производительности в задачах обработки данных с плавающей точкой и в аудиосистемах, содержат большой объем статической оперативной памяти, множество внутренних шин, которые предотвращают возникновение узких мест при вводе/выводе данных, и инновационные цифровые аудиоинтерфейсы (DAI). Новое ядро SHARC+ имеет набор команд, совместимый с процессорами SHARC предыдущих поколений, а также ряд усовершенствований архитектуры кэш-памяти и функцию предсказания ветвлений.

Благодаря интеграции передовых периферийных модулей и большого объема памяти, данные процессоры на базе ядер ARM Cortex-A5 и SHARC являются идеальной платформой для приложений, где требуется программная модель, близкая к процессорам RISC (reduced instruction set computing), поддержка мультимедийных данных и высокая производительность сигнальной обработки в рамках одного интегрированного корпуса. Подобные приложения могут возникать в самых различных областях, включая автомобильную промышленность, профессиональные аудиосистемы и промышленные системы, где требуется высокая производительность вычислений с плавающей точкой.

Процессоры ADSP-SC57x/2157x являются представителями семейства процессоров SHARC^®. Процессоры ADSP-SC57x включают в себя ядра SHARC+^® и ARM^® Cortex^®-A5. Ядра цифровых сигнальных процессоров основаны на разработанной компанией Analog Devices супергарвардской архитектуре (Super Harvard Architecture, SHARC), поддерживающей операции в режиме SIMD (одна команда – много данных, single-instruction, multiple data). Эти 32-/40-/64-разрядные процессоры, оптимизированные для обеспечения высокой производительности в задачах обработки данных с плавающей точкой и в аудиосистемах, содержат большой объем статической оперативной памяти, множество внутренних шин, которые предотвращают возникновение узких мест при вводе/выводе данных, и инновационные цифровые аудиоинтерфейсы (DAI). Новое ядро SHARC+ имеет набор команд, совместимый с процессорами SHARC предыдущих поколений, а также ряд усовершенствований архитектуры кэш-памяти и функцию предсказания ветвлений.

Благодаря интеграции передовых периферийных модулей и большого объема памяти, данные процессоры на базе ядер ARM Cortex-A5 и SHARC являются идеальной платформой для приложений, где требуется программная модель, близкая к процессорам RISC (reduced instruction set computing), поддержка мультимедийных данных и высокая производительность сигнальной обработки в рамках одного интегрированного корпуса. Подобные приложения могут возникать в самых различных областях, включая автомобильную промышленность, профессиональные аудиосистемы и промышленные системы, где требуется высокая производительность вычислений с плавающей точкой.

Процессоры ADSP-SC57x/2157x являются представителями семейства процессоров SHARC^®. Процессоры ADSP-SC57x включают в себя ядра SHARC+^® и ARM^® Cortex^®-A5. Ядра цифровых сигнальных процессоров основаны на разработанной компанией Analog Devices супергарвардской архитектуре (Super Harvard Architecture, SHARC), поддерживающей операции в режиме SIMD (одна команда – много данных, single-instruction, multiple data). Эти 32-/40-/64-разрядные процессоры, оптимизированные для обеспечения высокой производительности в задачах обработки данных с плавающей точкой и в аудиосистемах, содержат большой объем статической оперативной памяти, множество внутренних шин, которые предотвращают возникновение узких мест при вводе/выводе данных, и инновационные цифровые аудиоинтерфейсы (DAI). Новое ядро SHARC+ имеет набор команд, совместимый с процессорами SHARC предыдущих поколений, а также ряд усовершенствований архитектуры кэш-памяти и функцию предсказания ветвлений.

Благодаря интеграции передовых периферийных модулей и большого объема памяти, данные процессоры на базе ядер ARM Cortex-A5 и SHARC являются идеальной платформой для приложений, где требуется программная модель, близкая к процессорам RISC (reduced instruction set computing), поддержка мультимедийных данных и высокая производительность сигнальной обработки в рамках одного интегрированного корпуса. Подобные приложения могут возникать в самых различных областях, включая автомобильную промышленность, профессиональные аудиосистемы и промышленные системы, где требуется высокая производительность вычислений с плавающей точкой.

CrossCore® Embedded Studio - это интегрированная среда разработки (integrated development environment, IDE) мирового уровня для процессоров семейств Blackfin® и SHARC® компании Analog Devices. Она реализована на базе Eclipse^TM и использует новейшее поколение наших инструментов генерации кода, обеспечивая полноценную поддержку редактирования, отладки и сборки кода на языках ассемблера и C/C++.

CrossCore Embedded Studio также обеспечивает интеграцию с встроенными драйверами, программными службами и алгоритмическими программными модулями, которые могут быть использованы разработчиками, работающими с процессорами Blackfin и SHARC, в своих проектах. К ним относятся драйверы для внутренних и внешних периферийных модулей, стеки протоколов Ethernet и USB, популярная операционная система реального времени и файловая система, а также множество других программных средств. Эта простая в применении среда проектирования дает исключительные возможности поддержки проектирования и отладки приложений для многоядерных процессоров.

µC/OS-II™ Real-Time Kernel for CrossCore^® Embedded Studio (CCES) is the result of a partnership between Analog Devices and Micriµm to provide a user-friendly programming environment for µC/OS-II applications running on Analog Devices Blackfin^® and SHARC^® processor families. µC/OS-II^™ Real-Time Kernel seamlessly integrates with CrossCore Embedded Studio and provides a user interface for configuring the RTOS.

The µC/OS-II is Micrium’s widely-used RTOS, designed to save time on embedded system projects. µC/OS-II is available in multiple processor architectures, which makes it easy to port existing applications to Analog Devices’ processors.

µC/OS-II manages up to 250 application tasks each of which must be at a different priority. µC/OS-II includes: semaphores; event flags; mutual-exclusion semaphores that eliminate unbounded priority inversions; message mailboxes and queues; task, time and timer management; and fixed sized memory block management.

µC/OS-II ensures that NULL pointers are not passed, task level services from ISRs aren’t called, arguments are within allowable range, and specified options are valid. Each API function provides an error code regarding the outcome of the function call.

µC/OS-II’s footprint can be scaled to only contain the features required for a specific application. The execution time for most services provided by µC/OS-II is both constant and deterministic; execution times do not depend on the number of tasks running in the application.

There is a µC/OS-II validation suite available from Micriµm which provides all documentation necessary to support the use of µC/OS-II in safety-critical systems. Specifically, µC/OS-II is currently implemented in a wide array of high level of safety-critical devices, including:

• Those certified for Avionics DO-178B.
• Medical FDA pre-market notification (510(k)) and pre-market approval (PMA) devices.
• SIL3/SIL4 IEC for transportation and nuclear systems, µC/OS-II is 99% compliant with the Motor Industry Software Reliability Association (MISRA-C:1998) C Coding Standards.