JESD204 Interface Framework

The AD-FMCADC2-EBZ is a high-speed data acquisition board featuring the AD9625 single channel ADC at 2500 MSPS, in a FMC form factor which supports the JESD204B high speed serial interface. The AD9625 is a 12-bit monolithic sampling analog-to-digital converter (ADC) that operates at conversion rates of up to 2.5 GSPS. This product is designed for sampling wide bandwidth analog signals up to the second Nyquist zone. The combination of wide input bandwidth, high sampling rate, and excellent linearity of the AD9625 is ideally suited for spectrum analyzers, data acquisition systems, and a wide assortment of military electronics applications, such as radar and jamming/anti-jamming measures.

The board meets most of the FMC specifications in terms of mechanical size, mounting hole locations, and more. Although this board does meet most of the FMC specifications, it’s not meant as a commercial off-the-shelf (COTS) board. If you want a commercial, ready to integrate product, please refer to one of the many FMC manufacturers and the FMC specification (ANSI/VITA 57.1).

This board is targeted to use the ADI reference designs that work with Xilinx development systems. ADI provides complete source (HDL and software) to re-create those projects (minus the IP provided by the FPGA vendors, which we use), but may not provide enough info to port this to your custom platform

The design of the board is specifically tailored to synchronizing multiple AD-FMCADC2-EBZ boards together.  For more information on synchronization please refer to A Test Method for Synchronizing Multiple GSPS Converters.

The reference design includes the device data capture via the JESD204B serial interface and the SPI interface. The samples are written to the external DDR-DRAM. It allows programming the device and monitoring its internal registers via SPI.

AD-FMCADC3-EBZ - это плата высокоскоростного сбора данных, которая содержит одноканальный АЦП AD9625 с быстродействием 2500 MSPS и обладающий низкими искажениями усилитель ВЧ ADA4961 с цифровым управлением и полосой 3.2 ГГц. Плата выполнена в форм-факторе FMC и поддерживает высокоскоростной последовательный интерфейс JESD204B. Этот продукт предназначен для оцифровки широкополосных аналоговых сигналов в полосе частот вплоть до второй зоны Найквиста. Благодаря комбинации широкой полосы входного каскада, высокой частоты дискретизации и превосходной линейности AD9625 идеально подходит для спектроанализаторов, систем сбора данных и различных военных систем, например, радиолокационных систем и постановщиков помех/средств борьбы с преднамеренными помехами. Плата удовлетворяет большинству требований спецификации FMC в части механических габаритов, положения монтажных отверстий и т.п. Несмотря на это, она не является продуктом для коммерческого применения (commercial off the shelf, COTS). Если вам необходим коммерческий, готовый к интеграции продукт, вам следует обратиться к одному из многочисленных производителей плат в форм-факторе FMC и следовать спецификации FMC (ANSI/VITA 57.1). Данная плата предназначена для совместного использования с типовыми проектами Analog Devices, которые работают с системами проектирования компании Xilinx. Analog Devices предоставляет полный набор исходных кодов (HDL и программное обеспечение) для воссоздания этих проектов (за исключением используемых нами IP-ядер, предоставляемых производителями микросхем FPGA vendors), однако не может предоставить информацию в достаточном объеме для портирования решения на вашу нестандартную платформу.
Архитектура платы специально оптимизирована для поддержки синхронизации нескольких плат AD-FMCADC3-EBZ. Дополнительную информацию можно найти в статье Метод тестирования для синхронизации нескольких преобразователей с быстродействием более 1 GSPS (на англ. яз.).

The AD-FMCADC4-EBZ is a high speed 4-channel data acquisition board featuring two AD9680 dual channel ADC at 1000 MSPS and four ADA4961 low distortion, 3.2 GHz, RF DGA driving each converter. The FMC form factor supports the JESD204B high speed serial interface. All clocking and channel synchronization is support on-board using the AD9528 clock generator. This product is designed for sampling wide bandwidth analog signals up to the second Nyquist zone. The combination of wide input bandwidth, high sampling rate, and excellent linearity of the AD9680 is ideally suited for spectrum analyzers, data acquisition systems, and a wide assortment of military electronics applications, such as radar and jamming/anti-jamming measures.

The board meets most of the FMC specifications in terms of mechanical size, mounting hole locations, and more. Although this board does meet most of the FMC specifications, it’s not meant as a commercial off the shelf (COTS) board. If you want a commercial, ready to integrate product, please refer to one of the many FMC manufacturers and the FMC specification (ANSI/VITA 57.1).

This board is targeted to use the ADI reference designs that work with Xilinx development systems. ADI provides complete source (HDL and software) to re-create those projects (minus the IP provided by the FPGA vendors, which we use), but may not provide enough info to port this to your custom platform.

The design of the board is specifically tailored to synchronizing multiple AD-FMCADC4-EBZ boards together. For more information on synchronization please refer to A Test Method for Synchronizing Multiple GSPS Converters. The reference design includes the device data capture via the JESD204B serial interface and the SPI interface. The samples are written to the external DDR-DRAM. It allows programming the device and monitoring its internal registers via SPI.

The AD-FMCDAQ2-EBZ module is comprised of the AD9680 dual, 14-bit, 1.0 GSPS, JESD204B ADC, the AD9144 quad, 16-bit, 2.8 GSPS, JESD204B DAC, the AD9523-1 14-output, 1GHz clock, and power management components. It is clocked by an internally generated carrier platform via the FMC connector, comprising a completely self-contained data acquisition and signal synthesis prototyping platform. In an FMC footprint (84 mm × 69 mm), the module’s combination of wideband data conversion, clocking, and power closely approximates real-world hardware and software for system prototyping and design, with no compromise in signal chain performance.

Applications

• Electronic test and measurement equipment
• General-purpose software radios
• Radar systems
• Ultra wideband satellite receivers
• Point-to-point communication systems

The AD-FMCJESDADC1-EBZ is an easy-to-use FMC-based rapid development board comprising four 14-bit, 250 MSPS, A/D conversion channels and featuring a JESD204B high-speed serial output interface. The board contains two AD9250 dual-channel ADC ICs with on-board clocking and power supplies to facilitate seamless connectivity with the Xilinx ML605, KC705 or VC707 development platform.

Note

The AD-FMCJESDADC1-EBZ Rapid Prototyping module’s primary purpose is to facilitate understanding/validating/verifying the JESD204B interface within the FPGA development platform ecosystem. This module was designed to comply with all of the FMC physical specifications in terms of mechanical size and mounting hole locations, and as such, PCB layout tradeoffs were made which impact wideband ac performance in the first Nyquist zone. If your objective is AD9250 performance evaluation, please refer to the performance-optimized evaluation boards; their information can be found here.

The AD-FMComms11-EBZ board is a system platform board for communication infrastructure applications that demonstrates the Direct to RF (DRF) transmitter and observation receiver architecture. Using high sample rate RFDAC(s) and RFADC(s), a number of components in previous generation transmitters can be eliminated, such as mixers, modulators, IF amplifiers and filters. The objective being to bring the ADC or DAC as close to the antenna as possible, leading to possibly more cost effective and efficient communications solution.

It is composed of multi-GSPS RF ADC and DAC, AD9625 and AD9162 respectively. The transmit path contains a balun, low pass filter, gain block and variable attenuation to produce an output appropriate for a power amplifier module. Along the observation path, the PA output is coupled back into the board through a variable attenuator, a balun and finally the ADC. Clock management is taken care of on board; all the necessary clocks are generated from a reference. Power management is present as well.

Радиокарты ADRV9371-N/PCBZ и ADRV9371-W/PCBZ разработаны для демонстрации работы высококачественного широкополосного интегрированного радиотрансивера AD9371, предназначенного для применения в таких ВЧ приложениях, как базовые станции 4G, контрольно-измерительное оборудование и программно-определяемые радиосистемы. Эти радиокарты предоставляют инженерам-разработчикам, инженерам-программистам и специалистам по системной архитектуре платформу с одним трансивером 2×2 для оценки параметров устройства и быстрого макетирования разрабатываемой радиосистемы. Вся необходимая периферия для корректной работы радиокарты, включая высокоэффективный исключительно импульсный источник питания и высококачественную схему тактирования, расположена на плате.

Имеются оба варианта с узким и широким диапазоном перестройки.

ADRV9371-N/PCBZ оптимизирована для достижения лучших характеристик в узком диапазоне от 1,8 ГГц до 2,6 ГГц. За пределами указанного диапазона у платы будет наблюдаться снижение характеристик. В первую очередь эта плата предназначается для радиоинженеров, у которых есть возможность подключить AD9371 к испытательному стенду (векторному анализатору сигналов, генератору сигналов и т. д.) для достижения оптимальных характеристик.

ADRV9371-W/PCBZ работает в широком диапазоне от 300 МГц до 6 ГГц, однако, ВЧ характеристики снижены из-за согласования с широкополосным входным трактом. Эта плата первоначально предназначается для исследования системы путем подачи различных форм сигналов, сгенерированных командой разработчиков ПО еще до завершения работ по созданию собственного оборудования. Это необходимо тем разработчикам, которым нужно увидеть формы сигналов, не заботясь пока о таких характеристиках, как амплитуда вектора ошибки в 1% (EMV).

Данная плата взаимодействует с материнской платой Xilinx ZC706 (EK-Z7-ZC706-G) (приобретается отдельно).

AD9680 – это двухканальный 14-разрядный аналого-цифровой преобразователь (АЦП) с быстродействием 1 миллиард выборок в секунду (GSPS). Компонент включает в себя интегрированный буфер и схему выборки и хранения, что позволяет сократить габариты, уменьшить потребляемую мощность и упростить его применение. Он предназначен для оцифровки широкополосных аналоговых сигналов на частотах до 2 ГГц и оптимизирован для поддержания широкой полосы входного каскада, высокой частоты дискретизации, превосходной линейности и низкого энергопотребления при малых габаритах корпуса.

Ядра АЦП построены на базе многокаскадной дифференциальной конвейерной архитектуры с интегрированной логикой исправления ошибок в выходном коде. Каждый АЦП имеет широкополосный аналоговый входной каскад, который может работать с широким набором выбираемых пользователем диапазонов рабочего напряжения. Интегрированный источник опорного напряжения упрощает проектирование системы.

Входы аналоговых сигналов и тактовой синхронизации являются дифференциальными. Выход каждого АЦП подключен к цифровому преобразователю с понижением частоты (DDC), состоящему из 4 последовательно соединенных каскадов обработки сигнала: 12-разрядного преобразователя частоты (NCO) и 4 полуполосных децимирующих фильтров.

В дополнение к блокам DDC AD9680 имеет ряд функций, упрощающих реализацию автоматической регулировки усиления (АРУ) в приемниках систем связи. Программируемый пороговый детектор позволяет контролировать уровень мощности входного сигнала, используя выходные биты быстрого детектирования АЦП. Индикатор быстрого детектирования переключается в состояние высокого логического уровня, если уровень входного сигнала превышает программируемый порог. Поскольку данный индикатор имеет короткое время реакции, пользователь может быстро уменьшить коэффициент усиления системы для предотвращения перегрузки АЦП по входу.

Высокоскоростные последовательные интерфейсы вывода стандарта JESD204B Subclass 1 могут быть сконфигурированы пользователем для работы с 1, 2 или 4 линиями данных, в зависимости от конфигурации DDC и быстродействия приемного логического устройства. При помощи входных выводов SYSREF± и SYNCINB± поддерживается возможность синхронизации нескольких микросхем.

Компонент имеет широкие возможности управления энергопотреблением, позволяющие добиваться существенного снижения потребляемой мощности. Все функциональные возможности продукта программируются при помощи трехпроводного интерфейса SPI, работающего с напряжением питания от 1.8 В до 3.3 В.

AD9680 выпускается в бессвинцовом 64-выводном корпусе LFCSP и работает в промышленном температурном диапазоне от −40°C до +85°C. Данный продукт защищен патентом США.

Ключевые особенности продукта

1. Низкая потребляемая мощность на канал АЦП.
2. Широкая полоса при максимальном уровне сигнала позволяет осуществлять дискретизацию сигналов ПЧ в диапазоне до 2 ГГц.
3. Буферизированные входы с программируемым согласованием упрощают проектирование и реализацию фильтра.
4. Четыре интегрированных широкополосных децимирующих фильтра и генератор с цифровым управлением (NCO) для построения многодиапазонных приемников.
5. Конфигурируемый интерфейс последовательного порта (SPI) для управления различными параметрами и функциями продукта в соответствии с требованиями конкретной системы.
6. Программируемая функция быстрого детектирования перегрузки.
7. 64-выводный корпус LFCSP, 9 мм x 9 мм

Области применения

• Многодиапазонные, многорежимные цифровые приемники с разнесенным приемом
• Системы связи
  • 3G/4G, TD-SCDMA, W-CDMA, GSM, LTE
•  Программно определяемые радиосистемы общего назначения
• Сверхширокополосные спутниковые приемники
• Измерительная техника
• Радиолокация
• Радиоэлектронная разведка (SIGINT)
• Приемники восходящего потока в кабельных сетях DOCSIS 3.0
• Цифровые приемники обратного канала в гибридных волоконно-оптических/коаксиальных сетях

AD9625 – это монолитный 12-разрядный аналого-цифровой преобразователь (АЦП) с внутренней выборкой, работающий со скоростями преобразования до 2.5 миллиарда отсчетов в секунду (GSPS). Данный продукт предназначен для оцифровки широкополосных аналоговых сигналов в полосе частот вплоть до второй зоны Найквиста. Благодаря комбинации широкой полосы входного каскада, высокой частоты дискретизации и превосходной линейности AD9625 идеально подходит для применения в спектроанализаторах, системах сбора данных, а также широком спектре военной электроники, включая радиолокационные системы и постановщики помех/схемы противодействия помехам.

Входы аналогового сигнала, тактового сигнала и опорного напряжения (SYSREF±) являются дифференциальными. Высокоскоростной последовательный интерфейс вывода стандарта JESD204B может работать в различных конфигурациях с одной, двумя, четырьмя, шестью и восемью линиями данных. Продукт работает в промышленном температурном диапазоне от −40°C до +85°C.

Ключевые особенности продукта

1. Высокое качество преобразования: исключительный свободный от побочных составляющих динамический диапазон (SFDR) в проектах с высокой частотой дискретизации и непосредственной дискретизацией радиосигнала; точный интегрированный источник опорного напряжения.
2. Конфигурируемый интерфейс вывода цифровых данных формата JESD204B.
3. Порт SPI для управления различными функциями и параметрами продукта, включая формат данных, а также данные калибровки коэффициента усиления и смещения.

Области применения

• Спектроанализаторы
• Военная связь
• Радиолокационные системы
• Высококачественные цифровые запоминающие осциллографы
• Активные постановщики помех /схемы противодействия помехам
• Электронные средства разведки и средства радиоэлектронной борьбы

 

The AD9250 is a dual, 14-bit ADC with sampling speeds of up to 250 MSPS. The AD9250 is designed to support communications applications where low cost, small size, wide bandwidth, and versatility are desired.

The ADC cores feature a multistage, differential pipelined architecture with integrated output error correction logic. The ADC cores feature wide bandwidth inputs supporting a variety of user-selectable input ranges. An integrated voltage reference eases design considerations. A duty cycle stabilizer is provided to compensate for variations in the ADC clock duty cycle, allowing the converters to maintain excellent performance. The JESD204B high speed serial interface reduces board routing requirements and lowers pin count requirements for the receiving device.

By default, the ADC output data is routed directly to the two JESD204B serial output lanes. These outputs are at CML voltage levels. Four modes support any combination of M = 1 or 2 (single or dual converters) and L = 1 or 2 (one or two lanes). For dual ADC mode, data can be sent through two lanes at the maximum sampling rate of 250 MSPS. However, if data is sent through one lane, a sampling rate of up to 125 MSPS is supported. Synchronization inputs (SYNCINB± and SYSREF±) are provided.

Flexible power-down options allow significant power savings, when desired. Programmable overrange level detection is supported for each channel via the dedicated fast detect pins.

Programming for setup and control are accomplished using a 3-wire SPI-compatible serial interface.

The AD9250 is available in a 48-lead LFCSP and is specified over the industrial temperature range of −40°C to +85°C.

Product Highlights

1. Integrated dual, 14-bit, 170 MSPS/250 MSPS ADC.
2. The configurable JESD204B output block supports up to 5 Gbps per lane.
3. An on-chip, phase-locked loop (PLL) allows users to provide a single ADC sampling clock; the PLL multiplies the ADC sampling clock to produce the corresponding JESD204B data rate clock.
4. Support for an optional RF clock input to ease system board design.
5. Proprietary differential input maintains excellent SNR performance for input frequencies of up to 400 MHz.
6. Operation from a single 1.8 V power supply.
7. Standard serial port interface (SPI) that supports various product features and functions such as controlling the clock DCS, power-down, test modes, voltage reference mode, over range fast detection, and serial output configuration.

Applications

• Diversity radio systems
• Multimode digital receivers (3G)
  
  • TD-SCDMA, WiMAX, W-CDMA, CDMA2000, GSM, EDGE, LTE
• DOCSIS 3.0 CMTS upstream receive paths
• HFC digital reverse path receivers
• I/Q demodulation systems
• Smart antenna systems
• Electronic test and measurement equipment
• Radar receivers
• COMSEC radio architectures
• IED detection/jamming systems
• General-purpose software radios
• Broadband data applications

В течение ограниченного времени вы можете принять участие в живом тестировании AD6676 при помощи нашего программного обеспечения для удаленного оценивания характеристик.

AD6676 – это обладающая высокой степенью интеграции подсистема приемника промежуточной частоты (ПЧ), которая способна осуществлять оцифровку радиосигналов с полосой до 160 МГц, центрированных относительно ПЧ в диапазоне от 70 МГц до 450 МГц. В отличие от традиционных АЦП с дискретизацией на ПЧ AD6676 построен на базе перестраиваемого полосового Σ-Δ АЦП с высоким коэффициентом избыточной дискретизации, который избавляет от необходимости в использовании фильтров ПЧ на ПАВ и усилительных каскадов, настроенных на определенный диапазон, за счет чего достигается значительное упрощение структуры широкополосного радиоприемника. Интегрированный квадратурный цифровой преобразователь с понижением частоты с последующими выбираемыми децимирующими фильтрами уменьшает требуемую частоту дискретизации комплексных данных до приемлемых значений в диапазоне от 62.5 MSPS до 266.7 MSPS. Комплексные выходные данные с разрядностью 16 бит передаются в хост-процессор через интерфейс JESD204B, поддерживающий конфигурацию с одной или двумя линиями данных и обеспечивающий быстродействие до 5.333 Гбит/с.

Области применения

• Многорежимное, широкополосное оборудование инфраструктуры сотовых сетей
• Оборудование радиорелейных линий СВЧ диапазона
• Измерительная техника
  • Спектроанализаторы и анализаторы протоколов связи
• Программно определяемые радиосистемы

The AD9144 is a quad, 16-bit, high dynamic range digital-to-analog converter (DAC) that provides a maximum sample rate of 2.8 GSPS, permitting a multicarrier generation up to the Nyquist frequency. The DAC outputs are optimized to interface seamlessly with the ADRF6720 analog quadrature modulator (AQM) from Analog Devices, Inc. An optional 3-wire or 4-wire serial port interface (SPI) provides for programming/readback of many internal parameters. Full-scale output current can be programmed over a typical range of 13.9 mA to 27.0 mA. The AD9144 is available in an 88-lead LFCSP.

Product Highlights

1. Greater than 1 GHz, ultrawide complex signal bandwidth enables emerging wideband and multiband wireless applications.
2. Advanced low spurious and distortion design techniques provide high quality synthesis of wideband signals from baseband to high intermediate frequencies.
3. JESD204B Subclass 1 support simplifies multichip synchronization in software and hardware design.
4. Fewer pins for data interface width with a serializer/deserializer (SERDES) JESD204B eight-lane interface.
5. Programmable transmit enable function allows easy design balance between power consumption and wake-up time.
6. Small package size with 12 mm × 12 mm footprint.

Applications

• Wireless communications
  • 3G/4G W-CDMA base stations
  • Wideband repeaters
  • Software defined radios
• Wideband communications
  • Point-to-point
  • Local multipoint distribution service (LMDS) and multichannel multipoint distribution service (MMDS)
• Transmit diversity, multiple input/multiple output (MIMO)
• Instrumentation
• Automated test equipment

AD9152 - это двухканальный, 16-разрядный цифро-аналоговый преобразователь (ЦАП) с широким динамическим диапазоном, который обеспечивает максимальную частоту обновления 2.25 GSPS, позволяя формировать сигналы одновременно на многих несущих в диапазоне до частоты Найквиста. Выходные каскады ЦАП оптимизированы для непосредственного подключения к аналоговым квадратурным модуляторам ADRF6720 компании Analog Devices. Для программирования/считывания различных внутренних параметров компонент имеет опциональный трех- или четырехпроводной интерфейс последовательного порта (SPI). Выходной ток полной шкалы может программироваться пользователем в диапазоне от 4 мА до 20 мА. AD9152 выпускается в 56-выводном корпусе LFCSP и является представителем семейства TxDAC+^®.

Ключевые особенности продукта

1. Крайне широкая полоса сигнального тракта делает возможным появление принципиально новых широкополосных и многодиапазонных беспроводных систем.
2. Усовершенствованная архитектура с низким уровнем побочных спектральных составляющих и искажений обеспечивает высокое качество синтеза широкополосных сигналов в диапазоне от нуля до высоких промежуточных частот.
3. Конфигурируемый интерфейс JESD204B Subclass 1 с четырьмя линиями данных упрощает аппаратную и программную поддержку многокристальной синхронизации.
4. Меньше контактов для передачи данных за счет применения последовательно-параллельного (SERDES) интерфейса JESD204B.
5. Функция программного разрешения передачи упрощает достижение баланса между потребляемой мощностью и временем пробуждения.
6. Малые габариты корпуса, посадочное место 8 мм × 8 мм.

Области применения

• Беспроводная связь
  • Базовые станции LTE и GSM
  • Широкополосные повторители
  • Программно-определяемые радиосистемы
• Широкополосные системы связи
  • Радиорелейные линии СВЧ диапазона
  • LMDS/MMSD
• Системы с разнесенными передающими антеннами, MIMO (multiple input/multiple output)
• Измерительная техника
• Автоматическое тестовое оборудование

AD9162 – это высокопроизводительный, 16-разрядный цифро-аналоговый преобразователь (ЦАП), который поддерживает работу с частотой обновления данных до 6 миллиардов отсчетов в секунду (GSPS). Ядро ЦАП построено на базе архитектуры с четырьмя ключами и содержит интерполирующий фильтр с коэффициентом интерполяции 2×, позволяющий получить эффективную частоту обновления до 12 GSPS в некоторых режимах. Благодаря широкому динамическому диапазону и широкой рабочей полосе этот ЦАП идеально подходит для широкополосных радиочастотных (РЧ) схем с наиболее жесткими требованиями.

Широкая полоса и широкий динамический диапазон в режиме основной полосы (baseband) позволяют обеспечить соответствие требованиям к кабельной инфраструктуры стандарта DOCSIS 3.1 с полным максимальным спектром 1.794 ГГц. При помощи интерполирующего фильтра с коэффициентом интерполяции 2× (FIR85) AD9161/AD9162 могут быть сконфигурированы для работы с пониженной частотой передачи данных и пониженной тактовой частотой для сокращения общей потребляемой мощности системы и смягчения требований к фильтрации. В режиме смесителя (Mix-Mode™) AD9161/ AD9162 могут использоваться для воссоздания РЧ сигналов во второй и третьей зонах Найквиста на частотах до 7.5 ГГц при сохранении превосходного динамического диапазона. Выходной ток может программироваться в диапазоне от 8 мА до 38.76 мА. Интерфейс данных AD9161/AD9162 включает в себя до восьми линий JESD204B SERDES, количество и скорость передачи в которых программируется в соответствии с требованиями конкретного приложения.

Для конфигурирования и контроля состояния всех внутренних регистров AD9162 имеет последовательный периферийный интерфейс (SPI). AD9162 выпускается в корпусах CSP_BGA со 165 шариковыми контактами (8.0 мм × 8.0 мм, шаг между контактами 0.5 мм) или 169 шариковыми контактами (11 мм × 11 мм, шаг между контактами 0.8 мм). Имеется опция для свинцовой пайки.

Ключевые особенности продукта

1. Широкий динамический диапазон и широкая полоса воссоздания сигнала делают возможным синтез РЧ сигналов на частотах до 7.5 ГГц.
2. Интерфейс JESD204B SERDES с конфигурируемым количеством линий (до восьми) и скоростью передачи.
3. Ширина полосы и динамический диапазон с запасом удовлетворяют требованиям DOCSIS 3.1.

Области применения

• Широкополосные системы связи
  • DOCSIS 3.1: головные станции кабельных модемов (CMTS)/ видео по запросу (VOD)/граничные квадратурные амплитудные модуляторы (EQAM)
• Инфраструктура систем беспроводной связи
  • W-CDMA, LTE, LTE-A, радиорелейные линии
• Измерительные приборы, автоматическое тестовое оборудование
• Радары и средства постановки помех

AD9371 – высокоинтегрированный широкополосный ВЧ трансивер, который состоит из двух приемников и двух передатчиков, интегрированных синтезаторов и блоков цифровой обработки сигналов. ИС предлагает гибкую комбинацию высокой производительности и низкого энергопотребления, которые требуются в оборудовании микро и макро базовых станций 3G/4G в обоих приложениях дуплексной связи с частотным и временным разделением каналов (FDD и TDD). AD9371 работает в диапазоне от 300 МГц до 6000 МГц, перекрывая большинство лицензируемых и нелицензируемых частот сотовой связи. Приемники ИС поддерживают полосы частот до 100 МГц. В состав ИС также входят приемник наблюдения и передатчики с полосой до 250 МГц для реализации алгоритмов цифровой коррекции.

Приемопередатчик состоит из широкополосного тракта прямого преобразования с передовыми коэффициентом шума и линейностью. Каждая подсистема приемника и передатчика включает корректировку постоянного смещения, корректировку квадратурной ошибки, цифровые программируемые фильтры, что смягчает требования к цифровому процессору немодулированных сигналов. Несколько дополнительных функций, таких как дополнительный АЦП, дополнительный ЦАП, входы/выходы общего назначения, интегрированы для предоставления дополнительной возможностей мониторинга и управления.

Канал приемника наблюдения с двумя входами добавлен для отслеживания выхода каждого передатчика и реализации функций снижения взаимных помех и калибровки. Этот же канал может подключаться к трем входам приемника прослушивания, который может отслеживать активность в различных диапазонах радиочастот.

Быстродействующий интерфейс JESD204B поддерживает скорость в линии до 6144 МГц. Четыре линии выделены для передатчиков, другие четыре линии выделены для каналов приемников и приемника наблюдения.

Полностью интегрированные малопотребляющие синтезаторы с фазовой автоподстройкой частоты (ФАПЧ) и дробным коэффициентом деления обеспечивают высокую эффективность схем передатчика, приемника, приемника наблюдения и тактирования. Тщательный дизайн и методы трассировки платы обеспечивают требуемый уровень изоляции необходимый в приложениях высококачественных базовых станций. Все компоненты генераторов, управляемых напряжением (ГУН), и петлевых фильтров интегрированы для минимизации количества внешних компонентов.

Источник питания 1,3 В требуется для ядра AD9371, что контролируется стандартным последовательным 4-проводным портом. Другие напряжения питания обеспечивают необходимые уровни для цифрового интерфейса и оптимизации характеристик передатчика и дополнительных преобразователей. AD9371 имеет корпус CSP_BGA с размерами 12 мм × 12 мм и 196-ю шариковыми выводами.

Области применения

• Макро и микро базовые станции 3G/4G (BTS)
• Пикосоты 3G/4G с несколькими несущими
• Системы активных антенн дуплексной связи с частотным и временным разделением каналов (FDD и TDD)
• СВЧ системы транзитной передачи в условиях отсутствия прямой видимости (NLOS)

Микросхема AD9523-1, включающая в себя интегрированную схему ФАПЧ и ГУН с двумя делителями, обеспечивает функцию распределения тактового сигнала по нескольким выходам с малым дрожанием фазы. Интегрированный ГУН перестаивается в диапазоне от 2.94 ГГц до 2.96 ГГц.

AD9523-1 предназначен для формирования тактовых сигналов, соответствующих требованиям к базовым станциям стандартов LTE (long term evolution) и multicarrier GSM. Для поддержания фазового шума на низком уровне, необходимом для достижения приемлемого отношения сигнал-шум в преобразователях данных, сигнал опорной частоты генератора должен обладать малым дрожанием фазы и формироваться внешним кварцевым генератором, управляемым напряжением (VCXO).

Входные приемники, генератор и приемник с нулевой задержкой поддерживают работу как в несимметричном, так и в дифференциальном режимах. При подаче на вход восстановленного тактового сигнала опорной частоты системы и сигнала VXCO устройство генерирует 14 выходных сигналов с малым шумом в диапазоне частот от 1 МГц до 1 ГГц и один буферизированный выходной сигнал от входной схемы ФАПЧ (PLL1). Частота и фаза каждого выхода тактового сигнала может изменяться относительно другого выхода тактового сигнала при помощи функции выбора фазы делителя, которая не вносит дрожания фазы и обеспечивает грубую регулировку с шагом, равным половине периода выходного сигнала ГУН.

Устройство имеет внутреннюю память EEPROM для хранения пользовательских настроек регистров, загружаемых при включении питания и сбросе кристалла, которая может быть запрограммирована через последовательный интерфейс.

Области применения

• Базовые станции LTE и multicarrier GSM
• Инфраструктура беспроводных и широкополосных систем
• Медицинские измерительные приборы
• Тактирование быстродействующих АЦП, ЦАП, DDS, DDC, DUC и MxFE
• Распределение тактовых сигналов с малым фазовым шумом и малым дрожанием фазы
• Прямое исправление ошибок (G.710)
• Высокопроизводительные беспроводные трансиверы
• Аппаратура автоматического контроля (ATE) и высококачественные измерительные приборы