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よく聞かれる質問(FAQ)
特長
- Complete DS1/ISDN-PRI/J1 transceiver functionality
- Long and Short haul LIU
- Crystal-less jitter attenuator
- Generates DSX-1 and CSU line build-outs
- HDLC controller with 64-byte buffers Configurable for FDL or DS0 operation
- Dual two-frame elastic store slip buffers that can connect to asynchronous backplanes up to 8.192MHz
- 8.192MHz clock output locked to RCLK
- Interleaving PCM Bus Operation
- Per-channel loopback and idle code insertion
- 8-bit parallel control port muxed or nonmuxed buses (Intel or Motorola)
- Programmable output clocks for Fractional T1
- Fully independent transmit and receive functionality
- Generates/detects in-band loop codes from 1 to 8 bits in length including CSU loop codes
- IEEE 1149.1 JTAG-Boundary Scan
- Pin compatible with DS2152/54/354/554 SCTs
- 100-pin LQFP package (14 mm x 14 mm) 3.3V (DS21352) or 5V (DS21552) supply; low power CMOS
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DS21352
資料
Filters
1つが該当
データシート
3
DS21352-DS21552: 3.3V DS21352 and 5V DS21552 T1 Single Chip Transceivers Data Sheet (Rev.1)
2849: 3.3V DS21352及5V DS21552 T1单芯片收发器 Data Sheet
2849: 3.3V DS21352および5V DS21552 T1シングルチップトランシーバ Data Sheet
信頼性データ
1
17.88K
アプリケーション・ノート
3
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技術記事
9
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デザイン・ノート
23
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