ADF4196

低相位噪声,快速解决6 GHz 锁相频率合成器
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ADF4196频率合成器可以用来在无线接收机和发射机的上变频和下变频部分实现本振(LO),其结构专门设计用来满足基站的GSM/EDGE锁定时间要求,其快速建立功能则使ADF4196非常适合脉冲多普勒雷达应用。

ADF4196由低噪声数字鉴频鉴相器(PFD)和精密差分电荷泵组成。还有一个差分放大器,用来将电荷泵的差分输出转换为外部电压控制振荡器(VCO)的单端电压。Σ-Δ型小数插值器与N分频器一起使用,能够实现可编程模数小数N分频。此外,4位参考(R)分频器和片内倍频器允许PFD输入端的参考信号(REFIN)频率为可选值。

如果频率合成器与外部环路滤波器和VCO一起使用,则可以实现完整的锁相环(PLL)。开关结构确保PLL能在GSM时隙保护期间内建立,而无需第二PLL及相关的隔离开关。与以前的乒乓式GSM PLL结构相比,这种结构能节省成本,降低复杂度,减小PCB面积,并减少屏蔽和特性测试工作。

应用

  • GSM/EDGE基站
  • PHS基站
  • 脉冲多普勒雷达
  • 仪器仪表和测试设备
  • 波束形成/相控阵系统

产品生命周期

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本产品已上市。数据手册包含所有最终性能规格和工作条件。ADI公司推荐新设计使用这些产品。

评估套件

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本页面包含用于评估ADF4196低相位噪声、快速建立6 GHz PLL频率合成器的评估板的订购信息。

注意:ADF4196芯片需要焊接至EVAL-ADF4193EBZ2电路板。

该评估板需使用SDP控制器版以连接PC。SDP控制器板通过USB 2.0连接至PC。评估板将连接至SDP控制器板。评估板无法直接连接至PC。在PC上运行的评估软件通过SDP控制器板与评估板通信。SDP控制器板在以下订购指南中单独列出(EVAL-SDP-CS1Z)。如果以前未购买过SDP控制器板,请购买该产品以确保获得完整的评估设置。

软件代码及系统需求

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配套产品推荐

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ADF4196 配套产品

推荐 Linear Regulators

  • For high accuracy, 5V applications ,我们建议 ADP3334 .
  • For a step up, 3V to 5V regulator ,我们建议 ADP1613 .
  • For ultralow noise, 3V applications,150 mA output ,我们建议 ADP150 .
  • For ultalow noise, 3V applications, 200 mA output ,我们建议 ADP151 .

推荐 Divide-by-4 Prescaler

  • For a low noise, low power, fixed RF block ,我们建议 ADF5001 .

推荐 Modulators/Demodulators

  • For broadband quadrature IF/RF signals ,我们建议 ADL5375 或者 ADL5380 .

推荐 PLL Active Filter

  • For an ultralow noise, rail-to-rail amplifier ,我们建议 OP184 .

推荐 RF Mixers

  • For 10 MHz to 6 GHz, high dynamic range active mixers ,我们建议 ADL5801 或者 ADL5802 .

设计资源

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设计资源

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ADF4196 材料声明
PCN-PDN信息 质量和可靠性 原理图符号和PCB封装

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